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pci_delayed_sync(1).v
资源名称：pci_core_verilog.rar　[点击查看]
上传用户：quan1896
上传日期：2014-05-14
资源大小：211k
文件大小：40k
源码类别：

并行计算

开发平台：

Others

pci_delayed_sync(1).v：源码内容
  3. <!-- pf_header_start -->
  5. <html>
  6.   <head>
  7.     <META NAME="keywords" CONTENT="cores, VHDL, Verilog HDL, ASIC, Synthesizable,
  8.       standard cell, IP, Intellectual Property, 32-bit RISC, UART, PCI, SDRAM,
  9.       full custom, system on a chip, SOC, reusable, design, development, synthesis,
  10.       designs, developers, C, Linux, eCos, open, free, open source cores, RTL code,
  11.       system-on-a-chip, circuits, digital, GNU, GPL, core, controller, processor,
  12.       system design, chip design, EDA, design methodology, design tools, ASICs, programmable logic,
  13.       FPGA's, PLDs, CPLDs, verification, Synthesis, HDL, Simulation, IC design software,
  14.       semiconductor design, integrated circuits, system designs, chip designs, EDAs, 
  15.       design methodologies, design tool, ASIC, programmable logics, FPGA, PLD, CPLD, Synthesis, 
  16.       circuit, Synopsys, system design, chip design, programmable logic, FPGA's, PLDs, 
  17.       CPLDs, verification, Simulation">
  18.     <META NAME="description" CONTENT="OPENCORES.ORG endorses development and hosts
  19.       a repository of free, open-source cores (chip designs) and supplemental
  20.       platforms (boards).">
  21.     <STYLE type=text/css>
  22.       BODY {margin: 0;}
  23.       BODY, P, DIV, TD, TR, TH, FORM, OL, UL, LI, B, I, INPUT, TEXTAREA, SELECT,
  24.       FONT {font-size: 10pt; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  26.       P, TD, FORM, TEXTAREA {font-size: 10pt;}
  28.       H1, H2 {FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica; font-size: 13pt; text-decoration: none}
  30.       .noline {text-decoration: none;}
  32.       .menu_top {text-decoration: none; font-weight: bold;
  33.         font-size: 7pt; color: #000000; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;} 
  34.       .menu_section {text-decoration: none; font-weight: bold;
  35.         font-size: 10pt; color: #ffffff; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;} 
  36.       .menu_item {font-size: 10pt; color: #004488; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  37.       .menu_section_admin {text-decoration: none; font-weight: bold;
  38.         font-size: 10pt; color: #ffff44; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;} 
  39.       .page_title {text-decoration: none; font-weight: bold; color: #c00000; font-size: 13pt; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  40.       .block_title {text-decoration: none; font-weight: bold; font-size: 11pt; color: #000000; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  41.       .block_subtitle {text-decoration: none; font-weight: bold; font-size: 10pt; color: #000000; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  42.       .title {text-decoration: none; font-weight: bold; font-size: 10pt; color: #000000; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  44.       .large {font-size: 13pt; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  45.       .medium {font-size: 10pt; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  46.       .small {font-size: 7pt; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  47.       .ultrasmall {font-size: 3pt; FONT-FAMILY: Verdana, Tahoma, Arial, Helvetica;}
  49.       .button { font-family:Verdana, Tahoma, Arial, Helvetica; }
  50.       .searchfield {font-family: verdana, arial, helvetica; font-size: 10px; color: #333333; width: 80px; height: 17px;}
  52.     </STYLE>
  54.     <title>OPENCORES.ORG</title>
  56.     <script laguage="Javascript">
  57.       function check(msg) {
  58.         if(confirm(msg)) {
  59.           return true
  60.         } else {
  61.           return false
  62.         }
  63.       }
  64.     </script>
  66.   </head>
  68.   
  70.   <body 
  71.     bgcolor="#e0e0e0" 
  72.     topmargin="0" 
  73.     leftmargin="0" 
  74.     marginwidth="0" 
  75.     marginheight="0" 
  76.     link="#004488" 
  77.     alink="#ff3300"
  78.     vlink="#444444"
  79.   >
  81. <a name="top">
  82. <!-- pf_header_end -->
  83. <center>
  84. <table cellpadding=0 cellspacing=0 border=0 width=96%><tr>
  85. <td width=1 bgcolor=#000000><img width=1 src="/images/dotty.gif"></td>
  87. <td>
  89. <table border=0 cellpadding=0 cellspacing=0 width=100%>
  91. <tr><td background="/images/topbg.gif" bgcolor=#aaddff height=70>
  93. <table width=100% border=0 ><tr><td width=180>
  94. <a href="/"><img border=0 src="/images/oc_logo.gif"></a>
  95. </td><td>
  96. <center>
  98. <!--
  99. <a title="" href="/banner.cgi"><img width=468 height=60 border=0 alt="" src=""></a>
  100. //-->
  102. <script type="text/javascript"><!--
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  119. //--></script>
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  122. </script>
  123. </center>
  124. </td><td align=right>
  132. </td>
  133. </tr></table>
  135. </td></tr>
  136. <tr bgcolor=#000000><td><img height=1 src="/images/dotty.gif"></td></tr>
  137. <tr><td bgcolor=#ffffff>
  140. <table border=0 cellpadding=0 cellspacing=0 width=100%><tr>
  142. <td bgcolor=#ffee88 width=60% background="/images/menu1.gif"></td>
  143. <td bgcolor=#ffee88 width=15 background="/images/menu1.gif" align=right><input type=image border=0 src="/images/exp1pf.gif" onclick="javascript:window.location='/pf.cgi?url=/cvsweb.shtml/pci/rtl/verilog/pci_delayed_sync.v?rev=1.3'"></a></td>
  145. <td bgcolor=#ffffff align=right nowrap>
  146. &nbsp; &nbsp; &nbsp; &nbsp; 
  147. <font class=menu_top size=-1>
  148.         
  149.           <a class=menu_top href="/login.cgi/login">LOGIN</a>
  150.           
  151.             &nbsp; ::: &nbsp;
  152.           
  153.         
  154.           <a class=menu_top href="/recover_pass.cgi/recover_pass">RECOVER PASS</a>
  155.           
  156.             &nbsp; ::: &nbsp;
  157.           
  158.         
  159.           <a class=menu_top href="/get_account.cgi/get_account">GET ACCOUNT</a>
  160.           
  161.         
  163. &nbsp; &nbsp;
  164. </font>
  166. </td></tr>
  167. <tr bgcolor=#ffffff>
  168.   <td></td>
  169.   <td></td>
  170.   <td bgcolor=#000000><img src="/images/dotty.gif"></td>
  171. </tr>
  173. </table>
  175. <table border=0 cellpadding=0 cellspacing=0>
  176. <tr>
  177. <td width=10><img width=10 src="/images/dotty.gif"></td>
  179. <td width=120 valign=top>
  180.         
  181.         <table width=100% border=0 cellpadding=2 cellspacing=0>
  182.           <tr><td><img height=2 src="/images/dotty.gif"></td></tr>
  183.         
  184.          <tr><td bgcolor="#347FB8">
  185.            <img src="/images/bullet.gif">
  186.          
  187.            <font class=menu_section>Browse</font>
  188.          
  189.          </td></tr>
  190.           
  191.            <tr><td>
  192.               
  193.                   
  194.                       <li class=small>
  195.                   
  196.               
  197.             
  198.                 <a class=menu_item href="/browse.cgi/by_category"><font class=menu_item>Projects</font></a></li>
  199.             
  200.            </td></tr>
  201.             
  202.           
  203.            <tr><td>
  204.               
  205.                   
  206.                       <li class=small>
  207.                   
  208.               
  209.             
  210.                 <a class=menu_item href="/cvsweb.shtml/"><font class=menu_item>Code (CVS)</font></a></li>
  211.             
  212.            </td></tr>
  213.             
  214.           
  215.            <tr><td>
  216.               
  217.                   
  218.                       <li class=small>
  219.                   
  220.               
  221.             
  222.                 <a class=menu_item href="/forums.cgi"><font class=menu_item>Forums</font></a></li>
  223.             
  224.            </td></tr>
  225.             
  226.           
  227.            <tr><td>
  228.               
  229.                   
  230.                       <li class=small>
  231.                   
  232.               
  233.             
  234.                 <a class=menu_item href="/news.cgi/list/1"><font class=menu_item>News</font></a></li>
  235.             
  236.            </td></tr>
  237.             
  238.           
  239.            <tr><td>
  240.               
  241.                   
  242.                       <li class=small>
  243.                   
  244.               
  245.             
  246.                 <a class=menu_item href="/articles.cgi/list"><font class=menu_item>Articles</font></a></li>
  247.             
  248.            </td></tr>
  249.             
  250.           
  251.            <tr><td>
  252.               
  253.                   
  254.                       <li class=small>
  255.                   
  256.               
  257.             
  258.                 <a class=menu_item href="/polls.cgi/list"><font class=menu_item>Polls</font></a></li>
  259.             
  260.            </td></tr>
  261.             
  262.           
  263.           <tr><td><font size=-2>&nbsp;</font></td></tr>
  264.         
  265.          <tr><td bgcolor="#347FB8">
  266.            <img src="/images/bullet.gif">
  267.          
  268.            <font class=menu_section>OpenCores</font>
  269.          
  270.          </td></tr>
  271.           
  272.            <tr><td>
  273.               
  274.                   
  275.                       <li class=small>
  276.                   
  277.               
  278.             
  279.                 <a class=menu_item href="/faq.cgi/index"><font class=menu_item>FAQ</font></a></li>
  280.             
  281.            </td></tr>
  282.             
  283.           
  284.            <tr><td>
  285.               
  286.                   
  287.                       <li class=small>
  288.                   
  289.               
  290.             
  291.                 <a class=menu_item href="/projects.cgi/web/opencores/cvs_howto"><font class=menu_item>CVS HowTo</font></a></li>
  292.             
  293.            </td></tr>
  294.             
  295.           
  296.            <tr><td>
  297.               
  298.                   
  299.                       <li class=small>
  300.                   
  301.               
  302.             
  303.                 <a class=menu_item href="/projects.cgi/web/opencores/mission"><font class=menu_item>Mission</font></a></li>
  304.             
  305.            </td></tr>
  306.             
  307.           
  308.            <tr><td>
  309.               
  310.                   
  311.                       <li class=small>
  312.                   
  313.               
  314.             
  315.                 <a class=menu_item href="/projects.cgi/web/opencores/media"><font class=menu_item>Media</font></a></li>
  316.             
  317.            </td></tr>
  318.             
  319.           
  320.            <tr><td>
  321.               
  322.                   
  323.                       <li class=small>
  324.                   
  325.               
  326.             
  327.                 <a class=menu_item href="/projects.cgi/web/opencores/tools"><font class=menu_item>Tools</font></a></li>
  328.             
  329.            </td></tr>
  330.             
  331.           
  332.            <tr><td>
  333.               
  334.                   
  335.                       <li class=small>
  336.                   
  337.               
  338.             
  339.                 <a class=menu_item href="/projects.cgi/web/opencores/sponsors"><font class=menu_item>Sponsors</font></a></li>
  340.             
  341.            </td></tr>
  342.             
  343.           
  344.            <tr><td>
  345.               
  346.                   
  347.                       <li class=small>
  348.                   
  349.               
  350.             
  351.                 <a class=menu_item href="/projects.cgi/web/opencores/mirrors"><font class=menu_item>Mirrors</font></a></li>
  352.             
  353.            </td></tr>
  354.             
  355.           
  356.            <tr><td>
  357.               
  358.                   
  359.                       <li class=small>
  360.                   
  361.               
  362.             
  363.                 <a class=menu_item href="/projects.cgi/web/opencores/logos"><font class=menu_item>Logos</font></a></li>
  364.             
  365.            </td></tr>
  366.             
  367.           
  368.            <tr><td>
  369.               
  370.                   
  371.                       <li class=small>
  372.                   
  373.               
  374.             
  375.                 <a class=menu_item href="/projects.cgi/web/opencores/contacts"><font class=menu_item>Contact us</font></a></li>
  376.             
  377.            </td></tr>
  378.             
  379.           
  380.           <tr><td><font size=-2>&nbsp;</font></td></tr>
  381.         
  382.          <tr><td bgcolor="#347FB8">
  383.            <img src="/images/bullet.gif">
  384.          
  385.            <font class=menu_section>Tools</font>
  386.          
  387.          </td></tr>
  388.           
  389.            <tr><td>
  390.               
  391.                   
  392.                       <li class=small>
  393.                   
  394.               
  395.             
  396.                 <font class=menu_item><a href="/search.cgi">Search</a><br><table><tr><form action=/search.cgi/do_search><td><font class=small>&nbsp;&nbsp;</font></td><td><input class=searchfield type=text name=query></td></form></tr></table></font></li>
  397.             
  398.            </td></tr>
  399.             
  400.           
  401.            <tr><td>
  402.               
  403.                   
  404.                       <li class=small>
  405.                   
  406.               
  407.             
  408.                 <a class=menu_item href="/cvsget.shtml"><font class=menu_item>Download Cores (CVSGet)</font></a></li>
  409.             
  410.            </td></tr>
  411.             
  412.           
  413.           <tr><td><font size=-2>&nbsp;</font></td></tr>
  414.         
  415.          <tr><td bgcolor="#347FB8">
  416.            <img src="/images/bullet.gif">
  417.          
  418.            <font class=menu_section>More</font>
  419.          
  420.          </td></tr>
  421.           
  422.            <tr><td>
  423.               
  424.                   
  425.                       <li class=small>
  426.                   
  427.               
  428.             
  429.                 <a class=menu_item href="/projects.cgi/web/wishbone/"><font class=menu_item>Wishbone</font></a></li>
  430.             
  431.            </td></tr>
  432.             
  433.           
  434.            <tr><td>
  435.               
  436.                   
  437.                       <li class=small>
  438.                   
  439.               
  440.             
  441.                 <a class=menu_item href="/projects.cgi/web/perlilog/"><font class=menu_item>Perlilog</font></a></li>
  442.             
  443.            </td></tr>
  444.             
  445.           
  446.            <tr><td>
  447.               
  448.                   
  449.                       <li class=small>
  450.                   
  451.               
  452.             
  453.                 <a class=menu_item href="/projects.cgi/web/edatools/"><font class=menu_item>EDA tools</font></a></li>
  454.             
  455.            </td></tr>
  456.             
  457.           
  458.            <tr><td>
  459.               
  460.                   
  461.                       <li class=small>
  462.                   
  463.               
  464.             
  465.                 <a class=menu_item href="/projects.cgi/web/opentech/"><font class=menu_item>OpenTech CD</font></a></li>
  466.             
  467.            </td></tr>
  468.             
  469.           
  470.           <tr><td><font size=-2>&nbsp;</font></td></tr>
  471.         
  472.         </table>
  476. </td>
  477. <td width=10><img width=10 src="/images/dotty.gif"></td>
  478. <td background="/images/vpd.gif"><img width=1 src="/images/dotty.gif"></td>
  479. <td width=10><img width=10 src="/images/dotty.gif"></td>
  480. <td valign=top>
  483.         
  484.         <table width=100% cellpadding=2 cellspacing=0 border=0>
  485.           <tr><td><img height=2 src="/images/dotty.gif"></td></tr>
  486.         </table>
  487.         
  490. <table width=100% cellspacing=0 cellpadding=0 border=0><tr><td>
  492. <!-- pf_body_start -->
  500.  
  502. <!DOCTYPE html PUBLIC "-//W3C//DTD XHTML 1.0 Transitional//EN" "http://www.w3.org/TR/xhtml1/DTD/xhtml1-transitional.dtd">
  503. <html>
  504. <head>
  505. <title>pci/rtl/verilog/pci_delayed_sync.v - view - 1.3</title>
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  511. </head>
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  513. <table class="navigate-header" width="100%" summary="Navigation">
  514.  <tr>
  515.   <td>
  516. <a href="./pci_delayed_sync.v#rev1.3"><img src="/icons/back.gif" alt="[BACK]" border="0" width="20" height="22" /></a><b>Return to <a href="./pci_delayed_sync.v#rev1.3">pci_delayed_sync.v</a> CVS log</b> <img src="/icons/text.gif" alt="[TXT]" border="0" width="20" height="22" /></td>  <td style="text-align: right"><img src="/icons/dir.gif" alt="[DIR]" border="0" width="20" height="22" /> <b>Up to  <a href="/cvsweb.shtml/#dirlist">[Official OpenCores CVS Repository]</a> / <a href="/cvsweb.shtml/pci/#dirlist">pci</a> / <a href="/cvsweb.shtml/pci/rtl/#dirlist">rtl</a> / <a href="/cvsweb.shtml/pci/rtl/verilog/#dirlist">verilog</a></b></td>
  517.  </tr>
  518. </table>
  519. <hr />
  520. <div class="log-markup">
  521. File:&nbsp;
  522.  <a href="/cvsweb.shtml/#dirlist">[Official OpenCores CVS Repository]</a> / <a href="/cvsweb.shtml/pci/#dirlist">pci</a> / <a href="/cvsweb.shtml/pci/rtl/#dirlist">rtl</a> / <a href="/cvsweb.shtml/pci/rtl/verilog/#dirlist">verilog</a> / <a href="/cvsweb.shtml/pci/rtl/verilog/pci_delayed_sync.v">pci_delayed_sync.v</a><br />
  523. <a name="rev1.3"></a><a name="wb2hpi"></a><a name="rel_WB_B3"></a><a name="rel_9"></a><a name="rel_8"></a><a name="rel_7"></a><a name="rel_6"></a><a name="rel_13"></a><a name="rel_12"></a><a name="rel_11"></a><a name="rel_10"></a><a name="asyst_3"></a><a name="asyst_2"></a><a name="HEAD"></a>
  524.  Revision <b>1.3</b>: <a href="/cvsweb.cgi/~checkout~/pci/rtl/verilog/pci_delayed_sync.v?rev=1.3;content-type=text%2Fplain" class="download-link">download</a> - view: <a href="pci_delayed_sync.v?rev=1.3;content-type=text%2Fplain" class="display-link">text</a>, <a href="pci_delayed_sync.v?annotate=1.3">annotated</a> - <a href="pci_delayed_sync.v?r1=1.3#rev1.3">select&nbsp;for&nbsp;diffs</a><br />
  525. <i>Thu Aug 14 13:06:02 2003 UTC</i> (3 years, 9 months ago) by <i>simons</i><br />
  526. Branches: <a href="./pci_delayed_sync.v?only_with_tag=MAIN">MAIN</a><br />
  527. CVS tags: <a href="./pci_delayed_sync.v?only_with_tag=wb2hpi">wb2hpi</a>,
  528. <a href="./pci_delayed_sync.v?only_with_tag=rel_WB_B3">rel_WB_B3</a>,
  529. <a href="./pci_delayed_sync.v?only_with_tag=rel_9">rel_9</a>,
  530. <a href="./pci_delayed_sync.v?only_with_tag=rel_8">rel_8</a>,
  531. <a href="./pci_delayed_sync.v?only_with_tag=rel_7">rel_7</a>,
  532. <a href="./pci_delayed_sync.v?only_with_tag=rel_6">rel_6</a>,
  533. <a href="./pci_delayed_sync.v?only_with_tag=rel_13">rel_13</a>,
  534. <a href="./pci_delayed_sync.v?only_with_tag=rel_12">rel_12</a>,
  535. <a href="./pci_delayed_sync.v?only_with_tag=rel_11">rel_11</a>,
  536. <a href="./pci_delayed_sync.v?only_with_tag=rel_10">rel_10</a>,
  537. <a href="./pci_delayed_sync.v?only_with_tag=asyst_3">asyst_3</a>,
  538. <a href="./pci_delayed_sync.v?only_with_tag=asyst_2">asyst_2</a>,
  539. <a href="./pci_delayed_sync.v?only_with_tag=HEAD">HEAD</a><br />
  540. <pre class="log">
  541. synchronizer_flop replaced with pci_synchronizer_flop, artisan ram instance updated.
  542. </pre>
  543. </div>
  544. <hr /><pre>
  545. //////////////////////////////////////////////////////////////////////
  546. ////                                                              ////
  547. ////  File name &quot;delayed_sync.v&quot;                                  ////
  548. ////                                                              ////
  549. ////  This file is part of the &quot;PCI bridge&quot; project               ////
  550. ////  http://www.opencores.org/cores/pci/                         ////
  551. ////                                                              ////
  552. ////  Author(s):                                                  ////
  553. ////      - Miha Dolenc (mihad@opencores.org)                     ////
  554. ////                                                              ////
  555. ////  All additional information is avaliable in the README       ////
  556. ////  file.                                                       ////
  557. ////                                                              ////
  558. ////                                                              ////
  559. //////////////////////////////////////////////////////////////////////
  560. ////                                                              ////
  561. //// Copyright (C) 2001 Miha Dolenc, mihad@opencores.org          ////
  562. ////                                                              ////
  563. //// This source file may be used and distributed without         ////
  564. //// restriction provided that this copyright statement is not    ////
  565. //// removed from the file and that any derivative work contains  ////
  566. //// the original copyright notice and the associated disclaimer. ////
  567. ////                                                              ////
  568. //// This source file is free software; you can redistribute it   ////
  569. //// and/or modify it under the terms of the GNU Lesser General   ////
  570. //// Public License as published by the Free Software Foundation; ////
  571. //// either version 2.1 of the License, or (at your option) any   ////
  572. //// later version.                                               ////
  573. ////                                                              ////
  574. //// This source is distributed in the hope that it will be       ////
  575. //// useful, but WITHOUT ANY WARRANTY; without even the implied   ////
  576. //// warranty of MERCHANTABILITY or FITNESS FOR A PARTICULAR      ////
  577. //// PURPOSE.  See the GNU Lesser General Public License for more ////
  578. //// details.                                                     ////
  579. ////                                                              ////
  580. //// You should have received a copy of the GNU Lesser General    ////
  581. //// Public License along with this source; if not, download it   ////
  582. //// from http://www.opencores.org/lgpl.shtml                     ////
  583. ////                                                              ////
  584. //////////////////////////////////////////////////////////////////////
  585. //
  586. // CVS Revision History
  587. //
  588. // $Log: pci_delayed_sync.v,v $
  589. // Revision 1.3  2003/08/14 13:06:02  simons
  590. // synchronizer_flop replaced with pci_synchronizer_flop, artisan ram instance updated.
  591. //
  592. // Revision 1.2  2003/03/26 13:16:18  mihad
  593. // Added the reset value parameter to the synchronizer flop module.
  594. // Added resets to all synchronizer flop instances.
  595. // Repaired initial sync value in fifos.
  596. //
  597. // Revision 1.1  2003/01/27 16:49:31  mihad
  598. // Changed module and file names. Updated scripts accordingly. FIFO synchronizations changed.
  599. //
  600. // Revision 1.5  2002/09/25 09:54:50  mihad
  601. // Added completion expiration test for WB Slave unit. Changed expiration signalling
  602. //
  603. // Revision 1.4  2002/03/05 11:53:47  mihad
  604. // Added some testcases, removed un-needed fifo signals
  605. //
  606. // Revision 1.3  2002/02/01 15:25:12  mihad
  607. // Repaired a few bugs, updated specification, added test bench files and design document
  608. //
  609. // Revision 1.2  2001/10/05 08:14:28  mihad
  610. // Updated all files with inclusion of timescale file for simulation purposes.
  611. //
  612. // Revision 1.1.1.1  2001/10/02 15:33:46  mihad
  613. // New project directory structure
  614. //
  615. //
  617. // module provides synchronization mechanism between requesting and completing side of the bridge
  618. `include &quot;pci_constants.v&quot;
  619. `include &quot;bus_commands.v&quot;
  621. // synopsys translate_off
  622. `include &quot;timescale.v&quot;
  623. // synopsys translate_on
  625. module pci_delayed_sync
  626. (
  627.     reset_in,
  628.     req_clk_in,
  629.     comp_clk_in,
  630.     req_in,
  631.     comp_in,
  632.     done_in,
  633.     in_progress_in,
  634.     comp_req_pending_out,
  635.     req_req_pending_out,
  636.     req_comp_pending_out,
  637.     comp_comp_pending_out,
  638.     addr_in,
  639.     be_in,
  640.     addr_out,
  641.     be_out,
  642.     we_in,
  643.     we_out,
  644.     bc_in,
  645.     bc_out,
  646.     status_in,
  647.     status_out,
  648.     comp_flush_out,
  649.     burst_in,
  650.     burst_out,
  651.     retry_expired_in
  652. );
  654. // system inputs
  655. input reset_in,         // reset input
  656.       req_clk_in,       // requesting clock input
  657.       comp_clk_in ;     // completing clock input
  659. // request, completion, done and in progress indication inputs
  660. input req_in,           // request qualifier - when 1 it indicates that valid request data is provided on inputs
  661.       comp_in,          // completion qualifier - when 1, completing side indicates that request has completed
  662.       done_in,          // done input - when 1 indicates that requesting side of the bridge has completed a transaction on requesting bus
  663.       in_progress_in ;  // in progress indicator - indicates that current completion is in progress on requesting side of the bridge
  665. // pending indication outputs
  666. output  comp_req_pending_out,   // completion side request output - resynchronized from requesting clock to completing clock
  667.         req_req_pending_out,    // request pending output for requesting side
  668.         req_comp_pending_out,   // completion pending output for requesting side of the bridge - it indicates when completion is ready for completing on requesting bus
  669.         comp_comp_pending_out ; // completion pending output for completing side of the bridge
  671. // additional signals and wires for clock domain passage of signals
  672. reg     comp_req_pending,
  673.         req_req_pending,
  674.         req_comp_pending,
  675.         req_comp_pending_sample,
  676.         comp_comp_pending,
  677.         req_done_reg,
  678.         comp_done_reg_main,
  679.         comp_done_reg_clr,
  680.         req_rty_exp_reg,
  681.         req_rty_exp_clr,
  682.         comp_rty_exp_reg,
  683.         comp_rty_exp_clr ;
  685. wire    sync_comp_req_pending,
  686.         sync_req_comp_pending,
  687.         sync_comp_done,
  688.         sync_req_rty_exp,
  689.         sync_comp_rty_exp_clr ;
  691. // inputs from requesting side - only this side can set address, bus command, byte enables, write enable and burst - outputs are common for both sides
  692. // all signals that identify requests are stored in this module
  694. input [31:0]    addr_in ;   // address bus input
  695. input [3:0]     be_in ;     // byte enable input
  696. input           we_in ;     // write enable input - read/write request indication 1 = write request / 0 = read request
  697. input [3:0]     bc_in ;     // bus command input
  698. input           burst_in ;  // burst indicator    - qualifies operation as burst/single transfer 1 = burst / 0 = single transfer
  700. // common request outputs used both by completing and requesting sides
  701. // this outputs are not resynchronized, since flags determine the request status
  702. output [31:0]   addr_out ;
  703. output [3:0]    be_out ;
  704. output          we_out ;
  705. output [3:0]    bc_out ;
  706. output          burst_out ;
  708. // completion side signals encoded termination status - 0 = normal completion / 1 = error terminated completion
  709. input          status_in ;
  710. output         status_out ;
  712. // input signals that delayed transaction has been retried for max number of times
  713. // on this signal request is ditched, otherwise it would cause a deadlock
  714. // requestor can issue another request and procedure will be repeated
  715. input   retry_expired_in ;
  717. // completion flush output - if in 2^^16 clock cycles transaction is not repeated by requesting agent - flush completion data
  718. output  comp_flush_out ;
  720. // output registers for common signals
  721. reg [31:0]   addr_out ;
  722. reg [3:0]    be_out ;
  723. reg          we_out ;
  724. reg [3:0]    bc_out ;
  725. reg          burst_out ;
  727. // delayed transaction information is stored only when request is issued and request nor completion are pending
  728. wire new_request = req_in &amp;&amp; ~req_comp_pending_out &amp;&amp; ~req_req_pending_out ;
  729. always@(posedge req_clk_in or posedge reset_in)
  730. begin
  731.     if (reset_in)
  732.     begin
  733.         addr_out  &lt;= #`FF_DELAY 32'h0000_0000 ;
  734.         be_out    &lt;= #`FF_DELAY 4'h0 ;
  735.         we_out    &lt;= #`FF_DELAY 1'b0 ;
  736.         bc_out    &lt;= #`FF_DELAY `BC_RESERVED0 ;
  737.         burst_out &lt;= #`FF_DELAY 1'b0 ;
  738.     end
  739.     else
  740.         if (new_request)
  741.         begin
  742.             addr_out  &lt;= #`FF_DELAY addr_in ;
  743.             be_out    &lt;= #`FF_DELAY be_in ;
  744.             we_out    &lt;= #`FF_DELAY we_in ;
  745.             bc_out    &lt;= #`FF_DELAY bc_in ;
  746.             burst_out &lt;= #`FF_DELAY burst_in ;
  747.         end
  748. end
  750. // completion pending cycle counter
  751. reg [16:0] comp_cycle_count ;
  753. /*=================================================================================================================================
  754. Passing of requests between clock domains:
  755. request originates on requesting side. It's then synchronized with two flip-flops to cross to completing clock domain
  756. =================================================================================================================================*/
  757. // main request flip-flop triggered on requesting side's clock
  758. // request is cleared whenever completion or retry expired is signalled from opposite side of the bridge
  759. wire req_req_clear = req_comp_pending || (req_rty_exp_reg &amp;&amp; ~req_rty_exp_clr) ;
  760. always@(posedge req_clk_in or posedge reset_in)
  761. begin
  762.     if ( reset_in )
  763.         req_req_pending &lt;= #`FF_DELAY 1'b0 ;
  764.     else
  765.     if ( req_req_clear )
  766.         req_req_pending &lt;= #`FF_DELAY 1'b0 ;
  767.     else
  768.     if ( req_in )
  769.         req_req_pending &lt;= #`FF_DELAY 1'b1 ;
  770. end
  772. // interemediate stage request synchronization flip - flop - this one is prone to metastability
  773. // and should have setup and hold times disabled during simulation
  774. pci_synchronizer_flop #(1, 0) req_sync
  775. (
  776.     .data_in        (req_req_pending),
  777.     .clk_out        (comp_clk_in),
  778.     .sync_data_out  (sync_comp_req_pending),
  779.     .async_reset    (reset_in)
  780. ) ;
  782. // wire for clearing completion side request flag - whenever completion or retry expired are signalled
  783. wire comp_req_pending_clear = comp_req_pending &amp;&amp; ( comp_in || retry_expired_in) ;
  785. // wire for enabling request flip - flop - it is enabled when completion is not active and done is not active
  786. wire comp_req_pending_ena   = ~comp_comp_pending &amp;&amp; ~comp_done_reg_main &amp;&amp; ~comp_rty_exp_reg ;
  788. // completion side request flip flop - gets a value from intermediate stage sync flip flop
  789. always@(posedge comp_clk_in or posedge reset_in)
  790. begin
  791.     if ( reset_in )
  792.         comp_req_pending &lt;= #`FF_DELAY 1'b0 ;
  793.     else
  794.     if ( comp_req_pending_clear )
  795.         comp_req_pending &lt;= #`FF_DELAY 1'b0 ;
  796.     else
  797.     if ( comp_req_pending_ena )
  798.         comp_req_pending &lt;= #`FF_DELAY sync_comp_req_pending ;
  799. end
  801. // completion side request output assignment - when request ff is set and completion ff is not set
  802. assign comp_req_pending_out = comp_req_pending ;
  804. // requesting side request pending output
  805. assign req_req_pending_out  = req_req_pending ;
  806. /*=================================================================================================================================
  807. Passing of completions between clock domains:
  808. completion originates on completing side. It's then synchronized with two flip-flops to cross to requesting clock domain
  809. =================================================================================================================================*/
  810. // main completion Flip - Flop - triggered by completing side's clock
  811. // completion side completion pending flag is cleared when done flag propagates through clock domains
  812. wire comp_comp_clear = comp_done_reg_main &amp;&amp; ~comp_done_reg_clr ;
  813. always@(posedge comp_clk_in or posedge reset_in)
  814. begin
  815.     if ( reset_in )
  816.         comp_comp_pending &lt;= #`FF_DELAY 1'b0 ;
  817.     else
  818.     if ( comp_comp_clear )
  819.         comp_comp_pending &lt;= #`FF_DELAY 1'b0 ;
  820.     else
  821.     if ( comp_in &amp;&amp; comp_req_pending )
  822.         comp_comp_pending &lt;= #`FF_DELAY 1'b1 ;
  823. end
  825. assign comp_comp_pending_out = comp_comp_pending ;
  827. // interemediate stage completion synchronization flip - flop - this one is prone to metastability
  828. pci_synchronizer_flop #(1, 0) comp_sync
  829. (
  830.     .data_in        (comp_comp_pending),
  831.     .clk_out        (req_clk_in),
  832.     .sync_data_out  (sync_req_comp_pending),
  833.     .async_reset    (reset_in)
  834. ) ;
  836. // request side completion pending flip flop is cleared whenever done is signalled or completion counter expires - 2^^16 clock cycles
  837. wire req_comp_pending_clear = done_in || comp_cycle_count[16];
  839. // request side completion pending flip flop is disabled while done flag is set
  840. wire req_comp_pending_ena   = ~req_done_reg ;
  842. // request side completion flip flop - gets a value from intermediate stage sync flip flop
  843. always@(posedge req_clk_in or posedge reset_in)
  844. begin
  845.     if ( reset_in )
  846.         req_comp_pending &lt;= #`FF_DELAY 1'b0 ;
  847.     else
  848.     if ( req_comp_pending_clear )
  849.         req_comp_pending &lt;= #`FF_DELAY 1'b0 ;
  850.     else
  851.     if ( req_comp_pending_ena )
  852.         req_comp_pending &lt;= #`FF_DELAY sync_req_comp_pending ;
  853. end
  855. // sampling FF - used for sampling incoming completion flag from completing side
  856. always@(posedge req_clk_in or posedge reset_in)
  857. begin
  858.     if ( reset_in )
  859.         req_comp_pending_sample &lt;= #`FF_DELAY 1'b0 ;
  860.     else
  861.         req_comp_pending_sample &lt;= #`FF_DELAY sync_req_comp_pending ;
  862. end
  864. // requesting side completion pending output assignment
  865. assign req_comp_pending_out = req_comp_pending &amp;&amp; ~req_req_pending ;
  867. /*==================================================================================================================================
  868. Passing of delayed transaction done signal between clock domains.
  869. Done is signalled by requesting side of the bridge and is passed to completing side of the bridge
  870. ==================================================================================================================================*/
  871. // main done flip-flop triggered on requesting side's clock
  872. // when completing side removes completion flag, done flag is also removed, so requests can proceede
  873. wire req_done_clear = ~req_comp_pending_sample ;
  874. always@(posedge req_clk_in or posedge reset_in)
  875. begin
  876.     if ( reset_in )
  877.         req_done_reg &lt;= #`FF_DELAY 1'b0 ;
  878.     else
  879.     if ( req_done_clear )
  880.         req_done_reg &lt;= #`FF_DELAY 1'b0 ;
  881.     else
  882.     if ( done_in || comp_cycle_count[16] )
  883.         req_done_reg &lt;= #`FF_DELAY 1'b1 ;
  884. end
  886. pci_synchronizer_flop  #(1, 0) done_sync
  887. (
  888.     .data_in        (req_done_reg),
  889.     .clk_out        (comp_clk_in),
  890.     .sync_data_out  (sync_comp_done),
  891.     .async_reset    (reset_in)
  892. ) ;
  894. always@(posedge comp_clk_in or posedge reset_in)
  895. begin
  896.     if ( reset_in )
  897.         comp_done_reg_main &lt;= #`FF_DELAY 1'b0 ;
  898.     else
  899.         comp_done_reg_main &lt;= #`FF_DELAY sync_comp_done ;
  900. end
  902. always@(posedge comp_clk_in or posedge reset_in)
  903. begin
  904.     if ( reset_in )
  905.         comp_done_reg_clr &lt;= #`FF_DELAY 1'b0 ;
  906.     else
  907.         comp_done_reg_clr &lt;= #`FF_DELAY comp_done_reg_main ;
  908. end
  910. /*=================================================================================================================================
  911. Passing of retry expired signal between clock domains
  912. Retry expiration originates on completing side. It's then synchronized with two flip-flops to cross to requesting clock domain
  913. =================================================================================================================================*/
  914. // main retry expired Flip - Flop - triggered by completing side's clock
  915. wire comp_rty_exp_clear = comp_rty_exp_clr &amp;&amp; comp_rty_exp_reg ;
  917. // retry expired is a special case of transaction removal - retry expired propagates from completing
  918. // clock domain to requesting clock domain to remove all pending requests and than propagates back
  919. // to completing side to qualify valid new requests
  921. always@(posedge comp_clk_in or posedge reset_in)
  922. begin
  923.     if ( reset_in )
  924.         comp_rty_exp_reg &lt;= #`FF_DELAY 1'b0 ;
  925.     else
  926.     if ( comp_rty_exp_clear )
  927.         comp_rty_exp_reg &lt;= #`FF_DELAY 1'b0 ;
  928.     else
  929.     if ( retry_expired_in &amp;&amp; comp_req_pending)
  930.         comp_rty_exp_reg &lt;= #`FF_DELAY 1'b1 ;
  931. end
  933. // interemediate stage retry expired synchronization flip - flop - this one is prone to metastability
  934. pci_synchronizer_flop #(1, 0) rty_exp_sync
  935. (
  936.     .data_in        (comp_rty_exp_reg),
  937.     .clk_out        (req_clk_in),
  938.     .sync_data_out  (sync_req_rty_exp),
  939.     .async_reset    (reset_in)
  940. ) ;
  942. // request retry expired flip flop - gets a value from intermediate stage sync flip flop
  943. always@(posedge req_clk_in or posedge reset_in)
  944. begin
  945.     if ( reset_in )
  946.         req_rty_exp_reg &lt;= #`FF_DELAY 1'b0 ;
  947.     else
  948.         req_rty_exp_reg &lt;= #`FF_DELAY sync_req_rty_exp ;
  949. end
  951. always@(posedge req_clk_in or posedge reset_in)
  952. begin
  953.     if ( reset_in )
  954.         req_rty_exp_clr &lt;= #`FF_DELAY 1'b0 ;
  955.     else
  956.         req_rty_exp_clr &lt;= #`FF_DELAY req_rty_exp_reg ;
  957. end
  959. pci_synchronizer_flop #(1, 0) rty_exp_back_prop_sync
  960. (
  961.     .data_in        (req_rty_exp_reg &amp;&amp; req_rty_exp_clr),
  962.     .clk_out        (comp_clk_in),
  963.     .sync_data_out  (sync_comp_rty_exp_clr),
  964.     .async_reset    (reset_in)
  965. ) ;
  967. always@(posedge comp_clk_in or posedge reset_in)
  968. begin
  969.     if ( reset_in )
  970.         comp_rty_exp_clr &lt;= #`FF_DELAY 1'b0 ;
  971.     else
  972.         comp_rty_exp_clr &lt;= #`FF_DELAY sync_comp_rty_exp_clr ;
  973. end
  975. // completion status flip flop - if 0 when completion is signalled it's finished OK otherwise it means error
  976. reg status_out ;
  977. always@(posedge comp_clk_in or posedge reset_in)
  978. begin
  979.     if (reset_in)
  980.         status_out &lt;= #`FF_DELAY 1'b0 ;
  981.     else
  982.     if (comp_in &amp;&amp; comp_req_pending)
  983.         status_out &lt;= #`FF_DELAY status_in ;
  984. end
  986. // clocks counter - it counts how many clock cycles completion is present without beeing repeated
  987. // if it counts to 2^^16 cycles the completion must be ditched
  989. // wire for clearing this counter
  990. wire clear_count = in_progress_in || ~req_comp_pending_out || comp_cycle_count[16] ;
  991. always@(posedge req_clk_in or posedge reset_in)
  992. begin
  993.     if (reset_in)
  994.         comp_cycle_count &lt;= #`FF_DELAY 17'h0_0000 ;
  995.     else
  996.     if (clear_count)
  997.         comp_cycle_count &lt;= #`FF_DELAY 17'h0_0000 ;
  998.     else
  999.         comp_cycle_count &lt;= #`FF_DELAY comp_cycle_count + 1'b1 ;
  1000. end
  1002. // completion flush output - used for flushing fifos when counter expires
  1003. // if counter doesn't expire, fifo flush is up to WISHBONE slave or PCI target state machines
  1004. reg comp_flush_out ;
  1005. always@(posedge req_clk_in or posedge reset_in)
  1006. begin
  1007.     if (reset_in)
  1008.         comp_flush_out &lt;= #`FF_DELAY 1'b0 ;
  1009.     else
  1010.         comp_flush_out &lt;= #`FF_DELAY comp_cycle_count[16] ;
  1011. end
  1013. endmodule //delayed_sync
  1014. </pre>
  1015. <hr />
  1016. <address><span style="font-size: smaller">FreeBSD-CVSweb &lt;<a href="mailto:freebsd-cvsweb@FreeBSD.org">freebsd-cvsweb@FreeBSD.org</a>&gt;</span></address>
  1017. </body>
  1018. </html>
  1028. <!-- pf_body_end -->
  1030. </td>
  1031. <td><img width=15 src="/images/dotty.gif"></td>
  1032. </tr></table>
  1034. <xcenter>
  1036. <p>
  1037. <table width=100% cellpadding=0 cellspacing=0 border=0>
  1038.       <tr><td align=right valign=bottom><a title='Top' href='#top'><img border=0 alt='Top' src='/images/hr_up.gif'></a></td></tr>
  1039.       <tr><td background='/images/hpd.gif'><img height=1 border=0 src='/images/dotty.gif'></td></tr><tr><td height=4><img height=4 src='/images/dotty.gif'></td></tr></table>
  1040. &nbsp;
  1041. <br>
  1043. <!--
  1044. <table border=0 cellpadding=0 cellspacing=1 bgcolor=#ffffff><tr><td>
  1045. <table cellpadding=0 cellspacing=0 border=0 bgcolor=#ffffff><tr><td>
  1046. //-->
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  1062. //--></script>
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  1065. </script>
  1068. <!--
  1069. </td></tr></table>
  1070. </td></tr></table>
  1071. //-->
  1073. </center>
  1075. <img border=0 src="/images/dotty.gif" height=1 width=400>
  1076. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1077. <img border=0 src="/images/dotty.gif" height=1 width=30>
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  1079. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1080. <img border=0 src="/images/dotty.gif" height=1 width=30>
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  1095. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1096. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1097. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1098. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1099. <img border=0 src="/images/dotty.gif" height=1 width=30>
  1101. </td></tr>
  1102. </table>
  1104. &nbsp;
  1106. </td></tr>
  1108. <tr bgcolor=#000000><td><img height=1 src="/images/dotty.gif"></td></tr>
  1109. </table>
  1111. <table background="/images/topbg.gif" width=100% cellpadding=0 cellspacing=0 border=0 bgcolor=#aaddff>
  1112. <tr><td align=right>
  1113. Copyright (c) 1999-2007 OPENCORES.ORG. All rights reserved. &nbsp;
  1114. </td></tr>
  1115. <tr><td>
  1116. &nbsp;
  1117. </td></tr>
  1118. </table>
  1120. </td>
  1121. <td width=1 bgcolor=#000000><img width=1 src="/images/dotty.gif"></td>
  1122. <td width=1 bgcolor=#f0f0c8><img width=1 src="/images/dotty.gif"></td>
  1123. </tr></table>
  1124. </center>
  1126. <!-- pf_footer_start -->
  1128.   </body>
  1129. </html>
  1131. <!-- pf_footer_end -->