开通博客赚积分
发布资源赚积分
分类

源码开发语言/平台
当前位置：首页 > 源码/资料 > 嵌入式/单片机编程 > VxWorks > 查看源码
auLib.h
资源名称：ixp425BSP.rar　[点击查看]
上传用户：luoyougen
上传日期：2008-05-12
资源大小：23136k
文件大小：17k
源码类别：

VxWorks

开发平台：

C/C++

auLib.h：源码内容
  1. /* auLib.h - Au support header */
  3. /* Copyright 2001 Wind River Systems, Inc. */
  5. /*
  6.  * This file has been developed or significantly modified by the
  7.  * MIPS Center of Excellence Dedicated Engineering Staff.
  8.  * This notice is as per the MIPS Center of Excellence Master Partner
  9.  * Agreement, do not remove this notice without checking first with
  10.  * WR/Platforms MIPS Center of Excellence engineering management.
  11.  */
  13. /*
  14. modification history
  15. --------------------
  16. 01m,14may02,zmm  Global au1000 name changes. SPR 77333.
  17. 01l,30apr02,zmm  Add  AU1000_GPIO_PINFUNC definition.
  18. 01k,03dec01,zmm  Add CofE comment.
  19. 01j,27nov01,zmm  Add bits of counter control register, fix __cpluscplus bug.
  20. 01i,18oct01,pes  Merge changes
  21. 01h,03oct01,pes  Remove references to PHYS_TO_K1 macro so that this file
  22.                  becomes assembler safe.
  23. 01g,26sep01,tlc  Correct AC'97 macros.
  24. 01f,22aug01,pes  Add USB HOST register information
  25. 01e,13aug01,tlc  Add AC'97 Controller Information.
  26. 01d,13aug01,pes  Add defines needed to support PCI. Adjust addresses to make
  27.                  their KSEG1 locations more obvious.
  28. 01c,23jul01,zmm  Added Static Bus, SDRAM, UART, and clock Controllers.
  29. 01b,19jun01,zmm  Fix AU1000_INTERRUPT_CONTROLLER1_BASE
  30. 01a,18may01,mem  written.
  31. */
  33. /*
  34. This file contains I/O addresses and related constants for the
  35. Alchemy Semiconductor Au1000.
  36. */
  38. #ifndef __INCauh
  39. #define __INCauh
  41. #ifdef __cplusplus
  42. extern "C" {
  43. #endif  /* __cplusplus */
  45. #define MSK(n,m) (((1<<(n+1)) - 1) & ~((1<<(m)) - 1))
  47. /* Interrupt controllers */
  49. #define AU_INTERRUPT_CONTROLLER0_BASE (0xb0400000)
  50. #define AU_INTERRUPT_CONTROLLER1_BASE (0xb1800000)
  52. #define AU_INT_CTRL_REG(ctrl, reg)
  53. (*(volatile UINT32 *)(((ctrl) ? AU_INTERRUPT_CONTROLLER1_BASE 
  54. : AU_INTERRUPT_CONTROLLER0_BASE) + (reg)))
  56. #define AU_INTC_CONFIG0_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x40)
  57. #define AU_INTC_CONFIG0_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x40)
  58. #define AU_INTC_CONFIG0_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x44)
  59. #define AU_INTC_CONFIG1_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x48)
  60. #define AU_INTC_CONFIG1_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x48)
  61. #define AU_INTC_CONFIG1_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x4c)
  62. #define AU_INTC_CONFIG2_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x50)
  63. #define AU_INTC_CONFIG2_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x50)
  64. #define AU_INTC_CONFIG2_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x54)
  65. #define AU_INTC_REQUEST0_INT(ctrl) AU_INT_CTRL_REG(ctrl, 0x54)
  66. #define AU_INTC_SOURCE_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x58)
  67. #define AU_INTC_SOURCE_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x58)
  68. #define AU_INTC_SOURCE_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x5c)
  69. #define AU_INTC_REQUEST1_INT(ctrl) AU_INT_CTRL_REG(ctrl, 0x5c)
  70. #define AU_INTC_ASSIGN_REQUEST_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x60)
  71. #define AU_INTC_ASSIGN_REQUEST_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x60)
  72. #define AU_INTC_ASSIGN_REQUEST_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x64)
  73. #define AU_INTC_WAKEUP_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x68)
  74. #define AU_INTC_WAKEUP_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x68)
  75. #define AU_INTC_WAKEUP_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x6c)
  76. #define AU_INTC_MASK_READ(ctrl) AU_INT_CTRL_REG(ctrl, 0x70)
  77. #define AU_INTC_MASK_SET(ctrl) AU_INT_CTRL_REG(ctrl, 0x70)
  78. #define AU_INTC_MASK_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x74)
  79. #define AU_INTC_RISING_EDGE_DETECT(ctrl) AU_INT_CTRL_REG(ctrl, 0x78)
  80. #define AU_INTC_RISING_EDGE_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x78)
  81. #define AU_INTC_FALLING_EDGE_DETECT(ctrl) AU_INT_CTRL_REG(ctrl, 0x7c)
  82. #define AU_INTC_FALLING_EDGE_CLEAR(ctrl) AU_INT_CTRL_REG(ctrl, 0x7c)
  83. #define AU_INTC_TEST_BIT(ctrl) AU_INT_CTRL_REG(ctrl, 0x80)
  85. /* SDRAM controller */
  87. #define AU_SDRAM_CONTROLLER_BASE   (0xb4000000)
  88. #define AU_SDRAM_REG(reg) (AU_SDRAM_CONTROLLER_BASE + (reg))
  90. #define AU_SDRAM_CS_MODE_0          AU_SDRAM_REG(0x00)
  91. #define AU_SDRAM_CS_MODE_1          AU_SDRAM_REG(0x04)
  92. #define AU_SDRAM_CS_MODE_2          AU_SDRAM_REG(0x08)
  93. #define AU_SDRAM_CS_CONFIG_0        AU_SDRAM_REG(0x0c)
  94. #define AU_SDRAM_CS_CONFIG_1        AU_SDRAM_REG(0x10)
  95. #define AU_SDRAM_CS_CONFIG_2        AU_SDRAM_REG(0x14)
  96. #define AU_SDRAM_REFRESH_CONFIG     AU_SDRAM_REG(0x18)
  97. #define AU_SDRAM_PRECHARGE_CMD      AU_SDRAM_REG(0x1c)
  98. #define AU_SDRAM_AUTO_REFRESH_CMD   AU_SDRAM_REG(0x20)
  99. #define AU_SDRAM_WRITE_EXTERN_0     AU_SDRAM_REG(0x24)
  100. #define AU_SDRAM_WRITE_EXTERN_1     AU_SDRAM_REG(0x28)
  101. #define AU_SDRAM_WRITE_EXTERN_2     AU_SDRAM_REG(0x2c)
  102. #define AU_SDRAM_SLEEP              AU_SDRAM_REG(0x30)
  103. #define AU_SDRAM_TOGGLE_CKE         AU_SDRAM_REG(0x34)
  105. #define AU_SDRAM_CS_MODE_F (1<<22)
  106. #define AU_SDRAM_CS_MODE_SR (1<<21)
  107. #define AU_SDRAM_CS_MODE_BS (1<<20)
  108. #define AU_SDRAM_CS_MODE_RS MSK(19,18)
  109. #define AU_SDRAM_CS_MODE_CS MSK(17,15)
  110. #define AU_SDRAM_CS_MODE_TRAS MSK(14,11)
  111. #define AU_SDRAM_CS_MODE_TMRD MSK(10,9)
  112. #define AU_SDRAM_CS_MODE_TWR MSK(8,7)
  113. #define AU_SDRAM_CS_MODE_TRP MSK(6,5)
  114. #define AU_SDRAM_CS_MODE_TRCD MSK(4,3)
  115. #define AU_SDRAM_CS_MODE_TCL MSK(2,0)
  116. #define SET_SDRAM_CS_MODE_RS(x) ((x)<<18)
  117. #define SET_SDRAM_CS_MODE_CS(x) ((x)<<15)
  118. #define SET_SDRAM_CS_MODE_TRAS(x) ((x)<<11)
  119. #define SET_SDRAM_CS_MODE_TMRD(x) ((x)<<9)
  120. #define SET_SDRAM_CS_MODE_TWR(x) ((x)<<7)
  121. #define SET_SDRAM_CS_MODE_TRP(x) ((x)<<5)
  122. #define SET_SDRAM_CS_MODE_TRCD(x) ((x)<<3)
  123. #define SET_SDRAM_CS_MODE_TCL(x) (x)
  125. #define AU_SDRAM_CS_CONFIG_E (1<<20)
  126. #define AU_SDRAM_CS_CONFIG_CSBA MSK(19,10)
  127. #define AU_SDRAM_CS_CONFIG_CSMASK MSK(9,0)
  128. #define SET_SDRAM_CS_CONFIG_CSBA(x) ((x)<<10)
  129. #define SET_SDRAM_CS_CONFIG_CSMASK(x) (x)
  131. #define AU_SDRAM_REFRESH_CONFIG_TRC MSK(31,28)
  132. #define AU_SDRAM_REFRESH_CONFIG_TRPM MSK(27,26)
  133. #define AU_SDRAM_REFRESH_CONFIG_E (1<<25)
  134. #define AU_SDRAM_REFRESH_CONFIG_REF_INTER MSK(24,0)
  135. #define SET_SDRAM_REFRESH_CONFIG_TRC(x) ((x)<<28)
  136. #define SET_SDRAM_REFRESH_CONFIG_TRPR(x) ((x)<<26)
  137. #define SET_SDRAM_REFRESH_CONFIG_REF_INTER(x) (x)
  139. /* Static BUS controllers */
  141. #define AU_STATIC_CONTROLLER_BASE   (0xb4001000)
  142. #define AU_STATIC_REG(chipsel, reg) (AU_STATIC_CONTROLLER_BASE + 0x10*(chipsel) + reg)
  144. #define AU_STATIC_CONFIG(chipsel)   AU_STATIC_REG(chipsel, 0x0)
  145. #define AU_STATIC_TIMING(chipsel)   AU_STATIC_REG(chipsel, 0x4)
  146. #define AU_STATIC_ADDRESS(chipsel)  AU_STATIC_REG(chipsel, 0x8)
  148. #define AU_STATIC_CONFIG_BV  (1 << 12)
  149. #define AU_STATIC_CONFIG_D5  (1 << 11)
  150. #define AU_STATIC_CONFIG_AV  (1 << 10)
  151. #define AU_STATIC_CONFIG_LE         (1 << 9)
  152. #define AU_STATIC_CONFIG_TS  (1 << 8)
  153. #define AU_STATIC_CONFIG_EW  (1 << 7)
  154. #define AU_STATIC_CONFIG_H   (1 << 6)
  155. #define AU_STATIC_CONFIG_BS  (1 << 5)
  156. #define AU_STATIC_CONFIG_PM  (1 << 4)
  157. #define AU_STATIC_CONFIG_RO  (1 << 3)
  158. #define AU_STATIC_CONFIG_DTY  MSK(2,0)
  160. #define AU_STATIC_TIMING_TWCS MSK(30,28)
  161. #define AU_STATIC_TIMING_TCSH MSK(27,24)
  162. #define AU_STATIC_TIMING_TWP MSK(19,14)
  163. #define AU_STATIC_TIMING_TCSW MSK(13,10)
  164. #define AU_STATIC_TIMING_TPM MSK(9,6)
  165. #define AU_STATIC_TIMING_TA MSK(5,0)
  167. #define AU_STATIC_TIMING_TMST MSK(31,24)
  168. #define AU_STATIC_TIMING_TMSU MSK(23,17)
  169. #define AU_STATIC_TIMING_TMIH MSK(16,11)
  170. #define AU_STATIC_TIMING_TIST MSK(10,5)
  171. #define AU_STATIC_TIMING_TISU MSK(4,0)
  173. #define AU_STATIC_ADDRESS_E         (1<<28)
  174. #define AU_STATIC_ADDRESS_CSADDR MSK(27,14)
  175. #define AU_STATIC_ADDRESS_AMASK MSK(13,0)
  176. #define SET_STATIC_ADDRESS_CSADDR(x)   ((x)<<14)
  177. #define SET_STATIC_ADDRESS_AMASK(x) (x)
  179. /* Serial devices, UART 1 - UART 4 */
  180. #define UART0_BASE_ADR AU_UART_BASE
  181. #define AU_UART_BASE  (0xb1100000)
  182. #define AU_UART_REG(uart, reg)      (AU_UART_BASE + 0x100000*(uart) + (reg))
  184. #define AU_UART_RXDATA(uart) AU_UART_REG(uart,0x000)
  185. #define AU_UART_TXDATA(uart)  AU_UART_REG(uart,0x004)
  186. #define AU_UART_INTERRUPT_ENABLE(uart)  AU_UART_REG(uart,0x008)
  187. #define AU_UART_INTERRUPT_CAUSE(uart)  AU_UART_REG(uart,0x00C)
  188. #define AU_UART_FIFO_CONTROL(uart)  AU_UART_REG(uart,0x010)
  189. #define AU_UART_LINE_CONTROL(uart)  AU_UART_REG(uart,0x014)
  190. #define AU_UART_MODEM_CONTROL(uart)  AU_UART_REG(uart,0x018)
  191. #define AU_UART_LINE_STATUS(uart)  AU_UART_REG(uart,0x01C)
  192. #define AU_UART_MODEM_STATUS(uart)  AU_UART_REG(uart,0x020)
  193. #define AU_UART_CLOCK_DIVIDER(uart)  AU_UART_REG(uart,0x028)
  194. #define AU_UART_MODULE_CONTROL(uart) AU_UART_REG(uart,0x100)
  196. /* Clock controller */
  198. #define AU_CLOCK_BASE  (0xb1900000)
  199. #define AU_CLOCK_REG(reg)  (AU_CLOCK_BASE + (reg))
  201. #define AU_CLOCK_FREQUENCY_CONTROL0  AU_CLOCK_REG(0x20)
  202. #define AU_CLOCK_FREQUENCY_CONTROL1  AU_CLOCK_REG(0x24)
  203. #define AU_CLOCK_CLOCK_SOURCE_CONTROL  AU_CLOCK_REG(0x28)
  204. #define AU_CLOCK_CPU_PLL_CONTROL  AU_CLOCK_REG(0x60)
  205. #define AU_CLOCK_AUX_PLL_CONTROL  AU_CLOCK_REG(0x64)
  207. /* for use with AU_CLOCK_FREQUENCY_CONTROL0 register */
  208. #define AU_CLOCK_FREQUENCY_CONTROL_FS0      (1<<0)
  209. #define AU_CLOCK_FREQUENCY_CONTROL_FE0      (1<<1)
  210. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV0   MSK(9,2)
  212. #define AU_CLOCK_FREQUENCY_CONTROL_FS1      (1<<10)  
  213. #define AU_CLOCK_FREQUENCY_CONTROL_FE1      (1<<11)
  214. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV1   MSK(19,12)
  215.  
  216. #define AU_CLOCK_FREQUENCY_CONTROL_FS2      (1<<20)
  217. #define AU_CLOCK_FREQUENCY_CONTROL_FE2      (1<<21)
  218. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV2   MSK(29,22)
  219.  
  220. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV0_SH 2
  221. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV1_SH 12
  222. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV2_SH 22
  223.  
  224. /* for use with AU_CLOCK_FREQUENCY_CONTROL1 register */
  225. #define AU_CLOCK_FREQUENCY_CONTROL_FS3      (1<<0)
  226. #define AU_CLOCK_FREQUENCY_CONTROL_FE3      (1<<1)
  227. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV3   MSK(9,2)
  228.  
  229. #define AU_CLOCK_FREQUENCY_CONTROL_FS4      (1<<10)
  230. #define AU_CLOCK_FREQUENCY_CONTROL_FE4      (1<<11)
  231. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV4   MSK(19,12)
  232.  
  233. #define AU_CLOCK_FREQUENCY_CONTROL_FS5      (1<<20)
  234. #define AU_CLOCK_FREQUENCY_CONTROL_FE5      (1<<21)
  235. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV5   MSK(29,22)
  236.  
  237. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV3_SH 2
  238. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV4_SH 12
  239. #define AU_CLOCK_FREQUENCY_CONTROL_FRDIV5_SH 22
  241. #define AU_CLOCK_SOURCE_CONTROL_CIR         (1<<0)      
  242. #define AU_CLOCK_SOURCE_CONTROL_DIR         (1<<1)      
  243. #define AU_CLOCK_SOURCE_CONTROL_MIR         MSK(4,2)   
  244. #define AU_CLOCK_SOURCE_CONTROL_CUD         (1<<5)      
  245. #define AU_CLOCK_SOURCE_CONTROL_DUD         (1<<6)     
  246. #define AU_CLOCK_SOURCE_CONTROL_MUD         MSK(9,7)   
  247. #define AU_CLOCK_SOURCE_CONTROL_CUH         (1<<10)   
  248. #define AU_CLOCK_SOURCE_CONTROL_DUH         (1<<11)    
  249. #define AU_CLOCK_SOURCE_CONTROL_MUH         MSK(14,12) 
  250. #define AU_CLOCK_SOURCE_CONTROL_CI2         (1<<15)   
  251. #define AU_CLOCK_SOURCE_CONTROL_DI2         (1<<16)     
  252. #define AU_CLOCK_SOURCE_CONTROL_MI2         MSK(19,17)
  253. #define AU_CLOCK_SOURCE_CONTROL_CE0         (1<<20)    
  254. #define AU_CLOCK_SOURCE_CONTROL_DE0         (1<<21)   
  255. #define AU_CLOCK_SOURCE_CONTROL_ME0         MSK(24,22)  
  256. #define AU_CLOCK_SOURCE_CONTROL_CE1         (1<<25)   
  257. #define AU_CLOCK_SOURCE_CONTROL_DE1         (1<<26)     
  258. #define AU_CLOCK_SOURCE_CONTROL_ME1         MSK(29,27)  
  260. #define AU_CLOCK_SOURCE_CONTROL_IR_SH       2
  261. #define AU_CLOCK_SOURCE_CONTROL_UD_SH       7
  262. #define AU_CLOCK_SOURCE_CONTROL_UH_SH       12
  263. #define AU_CLOCK_SOURCE_CONTROL_I2_SH       17
  264. #define AU_CLOCK_SOURCE_CONTROL_E0_SH       22
  265. #define AU_CLOCK_SOURCE_CONTROL_E1_SH       27
  267. #define AU_CLOCK_SOURCE_CONTROL_AUX         0x1
  268. #define AU_CLOCK_SOURCE_CONTROL_FREQ0       0x2
  269. #define AU_CLOCK_SOURCE_CONTROL_FREQ1       0x3
  270. #define AU_CLOCK_SOURCE_CONTROL_FREQ2       0x4
  271. #define AU_CLOCK_SOURCE_CONTROL_FREQ3       0x5
  272. #define AU_CLOCK_SOURCE_CONTROL_FREQ4       0x6
  273. #define AU_CLOCK_SOURCE_CONTROL_FREQ5       0x7
  275. /* GPIO */
  276. #define AU_GPIO_BASE (0xb1900000)
  277. #define AU_GPIO_REG(reg) (AU_GPIO_BASE + (reg))
  279. #define AU_GPIO_PINFUNC AU_GPIO_REG(0x02c)
  280. #define AU_GPIO_TRISTATE_STATE_READ AU_GPIO_REG(0x100)
  281. #define AU_GPIO_TRISTATE_STATE_SET AU_GPIO_REG(0x100)
  282. #define AU_GPIO_OUTPUT_STATE_READ AU_GPIO_REG(0x108)
  283. #define AU_GPIO_OUTPUT_STATE_SET AU_GPIO_REG(0x108)
  284. #define AU_GPIO_OUTPUT_STATE_CLEAR AU_GPIO_REG(0x10c)
  285. #define AU_GPIO_PIN_STATE_READ      AU_GPIO_REG(0x110)
  286. #define AU_GPIO_PIN_INPUT_ENABLE      AU_GPIO_REG(0x110)
  287. #define AU_SYS_PIN_INPUT_EN         AU_GPIO_REG(0x110)
  289. /* AC'97 Controller */
  291. #define AU_AC97_BASE                        (0xb0000000)
  292. #define AU_AC97_REG(reg)                    (AU_AC97_BASE + (reg))
  294. #define AU_AC97_CONFIG                      AU_AC97_REG(0x00)
  295. #define AU_AC97_STATUS                      AU_AC97_REG(0x04)
  296. #define AU_AC97_DATA                        AU_AC97_REG(0x08)
  297. #define AU_AC97_CMMD                        AU_AC97_REG(0x0C)
  298. #define AU_AC97_CMMDRESP                    AU_AC97_REG(0x0C)
  299. #define AU_AC97_ENABLE                      AU_AC97_REG(0x10)
  301. #define AU_AC97_CONFIG_RSLOTS               MSK(22,13)
  302. #define AU_AC97_CONFIG_RSLOT3               (1 << 13)
  303. #define AU_AC97_CONFIG_RSLOT4               (1 << 14)
  304. #define AU_AC97_CONFIG_RSLOT5               (1 << 15)
  305. #define AU_AC97_CONFIG_RSLOT6               (1 << 16)
  306. #define AU_AC97_CONFIG_RSLOT7               (1 << 17)
  307. #define AU_AC97_CONFIG_RSLOT8               (1 << 18)
  308. #define AU_AC97_CONFIG_RSLOT9               (1 << 19)
  309. #define AU_AC97_CONFIG_RSLOT10              (1 << 20)
  310. #define AU_AC97_CONFIG_RSLOT11              (1 << 21)
  311. #define AU_AC97_CONFIG_RSLOT12              (1 << 22)
  313. #define AU_AC97_CONFIG_TSLOTS               MSK(12,3)
  314. #define AU_AC97_CONFIG_TSLOT3               (1 << 3)
  315. #define AU_AC97_CONFIG_TSLOT4               (1 << 4)
  316. #define AU_AC97_CONFIG_TSLOT5               (1 << 5)
  317. #define AU_AC97_CONFIG_TSLOT6               (1 << 6)
  318. #define AU_AC97_CONFIG_TSLOT7               (1 << 7)
  319. #define AU_AC97_CONFIG_TSLOT8               (1 << 8)
  320. #define AU_AC97_CONFIG_TSLOT9               (1 << 9)
  321. #define AU_AC97_CONFIG_TSLOT10              (1 << 10)
  322. #define AU_AC97_CONFIG_TSLOT11              (1 << 11)
  323. #define AU_AC97_CONFIG_TSLOT12              (1 << 12)
  325. #define AU_AC97_CONFIG_ACLINK_RESET         (1 << 0)
  327. #define AU_AC97_STATUS_READY                (1 << 7)
  328. #define AU_AC97_STATUS_CP                   (1 << 6)
  330. #define AU_AC97_CMMD_READ                   (1 << 7)
  331. #define AU_AC97_CMMD_INDEX                  MSK(6,0)
  333. #define AU_AC97_ENABLE_CTRL                 (1 << 4)
  334. #define AU_AC97_ENABLE_CLOCK                (1 << 0)
  336. #define SET_AC97_COMMAND(reg, value)            ((value) << 16 | reg )
  337. #define GET_AC97_COMMAND(reg)                   (reg >> 16)
  339. /* USB Controller */
  340. #define AU_USB_HOST_BASE (0xb0100000)
  341. #define AU_USB_HOST_REG(reg) (AU_USB_HOST_BASE + (reg))
  343. #define AU_USB_HOST_ENABLE AU_USB_HOST_REG(0x7fffc)
  344. /* bits in host config register */
  345. #define AU_USB_HOST_ENABLE_RD (1 << 4) /* Reset Done */
  346. #define AU_USB_HOST_ENABLE_CE (1 << 3) /* Clock Enable */
  347. #define AU_USB_HOST_ENABLE_E (1 << 2) /* Enable */
  348. #define AU_USB_HOST_ENABLE_C (1 << 1) /* Cacheable */
  349. #define AU_USB_HOST_ENABLE_BE (1 << 0) /* Big Endian */
  352. #define AU_SYS_BASE (0xb1900000)
  353. #define AU_SYS_REG(reg) (AU_SYS_BASE + (reg))
  355. #define AU_SYS_TOY_TRIM AU_SYS_REG(0x00)
  356. #define AU_SYS_TOY_WRITE AU_SYS_REG(0x04)
  357. #define AU_SYS_TOY_MATCH_0 AU_SYS_REG(0x08)
  358. #define AU_SYS_TOY_MATCH_1 AU_SYS_REG(0x0c)
  359. #define AU_SYS_TOY_MATCH_2 AU_SYS_REG(0x10)
  360. #define AU_SYS_COUNTER_CONTROL AU_SYS_REG(0x14)
  361. #define AU_SYS_SCRATCH_0 AU_SYS_REG(0x18)
  362. #define AU_SYS_SCRATCH_1 AU_SYS_REG(0x1c)
  363. #define AU_SYS_FREQ_CONTROL_0 AU_SYS_REG(0x20)
  364. #define AU_SYS_FREQ_CONTROL_1 AU_SYS_REG(0x24)
  365. #define AU_SYS_CLOCK_SOURCE AU_SYS_REG(0x28)
  366. #define AU_SYS_PIN_FUNCTION AU_SYS_REG(0x2c)
  368. #define AU_SYS_WAKE_MASK AU_SYS_REG(0x34)
  369. #define AU_SYS_ENDIAN AU_SYS_REG(0x38)
  370. #define AU_SYS_POWER_CONTROL AU_SYS_REG(0x3c)
  371. #define AU_SYS_TOY_READ AU_SYS_REG(0x40)
  372. #define AU_SYS_RTC_TRIM AU_SYS_REG(0x44)
  373. #define AU_SYS_RTC_WRITE AU_SYS_REG(0x48)
  374. #define AU_SYS_RTC_MATCH_0 AU_SYS_REG(0x4c)
  375. #define AU_SYS_RTC_MATCH_1 AU_SYS_REG(0x50)
  376. #define AU_SYS_RTC_MATCH_2 AU_SYS_REG(0x54)
  377. #define AU_SYS_RTC_READ AU_SYS_REG(0x58)
  378. #define AU_SYS_WAKE_SOURCE AU_SYS_REG(0x5c)
  379. #define AU_SYS_CPU_PLL AU_SYS_REG(0x60)
  380. #define AU_SYS_AUX_PLL AU_SYS_REG(0x64)
  382. #define AU_SYS_SLEEP_POWER AU_SYS_REG(0x78)
  383. #define AU_SYS_SLEEP AU_SYS_REG(0x7c)
  385. /* bits in RTC and TOY control register */
  386. #define AU_SYS_COUNTER_CONTROL_ERS  (1 << 23)
  387. #define AU_SYS_COUNTER_CONTROL_RTS  (1 << 20)
  388. #define AU_SYS_COUNTER_CONTROL_RM2  (1 << 19)
  389. #define AU_SYS_COUNTER_CONTROL_RM1  (1 << 18)
  390. #define AU_SYS_COUNTER_CONTROL_RM0  (1 << 17)
  391. #define AU_SYS_COUNTER_CONTROL_RS   (1 << 16)
  392. #define AU_SYS_COUNTER_CONTROL_BP   (1 << 14)
  393. #define AU_SYS_COUNTER_CONTROL_REN  (1 << 13)
  394. #define AU_SYS_COUNTER_CONTROL_BRT  (1 << 12)
  395. #define AU_SYS_COUNTER_CONTROL_TEN  (1 << 11)
  396. #define AU_SYS_COUNTER_CONTROL_BTT  (1 << 10)
  397. #define AU_SYS_COUNTER_CONTROL_EO   (1 << 8)
  398. #define AU_SYS_COUNTER_CONTROL_ETS  (1 << 7)
  399. #define AU_SYS_COUNTER_CONTROL_32S  (1 << 5)
  400. #define AU_SYS_COUNTER_CONTROL_TTS  (1 << 4)
  401. #define AU_SYS_COUNTER_CONTROL_TM2  (1 << 3)
  402. #define AU_SYS_COUNTER_CONTROL_TM1  (1 << 2)
  403. #define AU_SYS_COUNTER_CONTROL_TM0  (1 << 1)
  404. #define AU_SYS_COUNTER_CONTROL_TS   (1 << 0)
  406. #ifdef __cplusplus
  407. }
  408. #endif /* __cplusplus */
  409. #endif /* __INCauah */