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examp1.fit.rpt
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上传用户：jinxingdao
上传日期：2021-04-27
资源大小：415k
文件大小：65k
源码类别：
扫描程序
开发平台：
VHDL
- Fitter report for examp1
- Fri Jan 22 09:53:23 2010
- Quartus II Version 7.2 Build 151 09/26/2007 SJ Full Version
- ---------------------
- ; Table of Contents ;
- ---------------------
- 1. Legal Notice
- 2. Fitter Summary
- 3. Fitter Settings
- 4. Fitter Device Options
- 5. Input Pins
- 6. Output Pins
- 7. All Package Pins
- 8. Control Signals
- 9. Global & Other Fast Signals
- 10. Non-Global High Fan-Out Signals
- 11. Peripheral Signals
- 12. LAB
- 13. Local Routing Interconnect
- 14. LAB External Interconnect
- 15. Row Interconnect
- 16. LAB Column Interconnect
- 17. LAB Column Interconnect
- 18. Fitter Resource Usage Summary
- 19. Fitter Resource Utilization by Entity
- 20. Delay Chain Summary
- 21. Pin-Out File
- 22. Fitter Messages
- ----------------
- ; Legal Notice ;
- ----------------
- Copyright (C) 1991-2007 Altera Corporation
- Your use of Altera Corporation's design tools, logic functions
- and other software and tools, and its AMPP partner logic
- functions, and any output files from any of the foregoing
- (including device programming or simulation files), and any
- associated documentation or information are expressly subject
- to the terms and conditions of the Altera Program License
- Subscription Agreement, Altera MegaCore Function License
- Agreement, or other applicable license agreement, including,
- without limitation, that your use is for the sole purpose of
- programming logic devices manufactured by Altera and sold by
- Altera or its authorized distributors. Please refer to the
- applicable agreement for further details.
- +------------------------------------------------------------------+
- ; Fitter Summary ;
- +-----------------------+------------------------------------------+
- ; Fitter Status ; Successful - Fri Jan 22 09:53:23 2010 ;
- ; Quartus II Version ; 7.2 Build 151 09/26/2007 SJ Full Version ;
- ; Revision Name ; examp1 ;
- ; Top-level Entity Name ; examp1 ;
- ; Family ; FLEX10K ;
- ; Device ; EPF10K10QI208-4 ;
- ; Timing Models ; Final ;
- ; Total logic elements ; 196 / 576 ( 34 % ) ;
- ; Total pins ; 124 / 134 ( 93 % ) ;
- ; Total memory bits ; 0 / 6,144 ( 0 % ) ;
- +-----------------------+------------------------------------------+
- +------------------------------------------------------------------------------------------------------+
- ; Fitter Settings ;
- +------------------------------------------------------------+--------------------+--------------------+
- ; Option ; Setting ; Default Value ;
- +------------------------------------------------------------+--------------------+--------------------+
- ; Device ; EPF10K10QI208-4 ; ;
- ; Use smart compilation ; Off ; Off ;
- ; Use TimeQuest Timing Analyzer ; Off ; Off ;
- ; Router Timing Optimization Level ; Normal ; Normal ;
- ; Placement Effort Multiplier ; 1.0 ; 1.0 ;
- ; Router Effort Multiplier ; 1.0 ; 1.0 ;
- ; Equivalent RAM and MLAB Paused Read Capabilities ; Care ; Care ;
- ; Optimize Timing ; Normal compilation ; Normal compilation ;
- ; Optimize IOC Register Placement for Timing ; On ; On ;
- ; Limit to One Fitting Attempt ; Off ; Off ;
- ; Final Placement Optimizations ; Automatically ; Automatically ;
- ; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
- ; Fitter Initial Placement Seed ; 1 ; 1 ;
- ; Slow Slew Rate ; Off ; Off ;
- ; Auto Global Memory Control Signals ; Off ; Off ;
- ; Logic Cell Insertion - Individual Logic Cells ; On ; On ;
- ; Logic Cell Insertion - I/Os Fed By Carry or Cascade Chains ; On ; On ;
- ; Fitter Effort ; Auto Fit ; Auto Fit ;
- ; Auto Global Clock ; On ; On ;
- ; Auto Global Output Enable ; On ; On ;
- ; Auto Global Register Control Signals ; On ; On ;
- +------------------------------------------------------------+--------------------+--------------------+
- +-------------------------------------------------------------------------+
- ; Fitter Device Options ;
- +----------------------------------------------+--------------------------+
- ; Option ; Setting ;
- +----------------------------------------------+--------------------------+
- ; Enable user-supplied start-up clock (CLKUSR) ; Off ;
- ; Enable device-wide reset (DEV_CLRn) ; Off ;
- ; Enable device-wide output enable (DEV_OE) ; Off ;
- ; Enable INIT_DONE output ; Off ;
- ; Configuration scheme ; Passive Serial ;
- ; nWS, nRS, nCS, CS ; Unreserved ;
- ; RDYnBUSY ; Unreserved ;
- ; Data[7..1] ; Unreserved ;
- ; Reserve all unused pins ; As output driving ground ;
- ; Base pin-out file on sameframe device ; Off ;
- +----------------------------------------------+--------------------------+
- +----------------------------------------------------------------------------------------------------------------------------------------+
- ; Input Pins ;
- +--------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+---------------+--------------+
- ; Name ; Pin # ; Row ; Col. ; Fan-Out ; Global ; I/O Register ; Use Local Routing Input ; Power Up High ; Single-Pin CE ; I/O Standard ;
- +--------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+---------------+--------------+
- ; CLK ; 79 ; -- ; -- ; 52 ; yes ; no ; no ; no ; no ; TTL ;
- ; SIGNAL ; 78 ; -- ; -- ; 2 ; no ; no ; no ; no ; no ; TTL ;
- ; CLR ; 184 ; -- ; -- ; 49 ; yes ; no ; no ; no ; no ; TTL ;
- +--------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+---------------+--------------+
- +--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
- ; Output Pins ;
- +----------+-------+-----+------+--------------+--------------------------+---------------+----------------+---------------+---------------+------------+---------------+--------------+
- ; Name ; Pin # ; Row ; Col. ; I/O Register ; Use Local Routing Output ; Power Up High ; Slow Slew Rate ; Single-Pin OE ; Single-Pin CE ; Open Drain ; TRI Primitive ; I/O Standard ;
- +----------+-------+-----+------+--------------+--------------------------+---------------+----------------+---------------+---------------+------------+---------------+--------------+
- ; co1 ; 92 ; -- ; 8 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co2 ; 87 ; -- ; 10 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co3 ; 121 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co4 ; 166 ; -- ; 5 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co5 ; 24 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co6 ; 25 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co7 ; 30 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co8 ; 67 ; -- ; 17 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co9 ; 142 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co10 ; 13 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co11 ; 64 ; -- ; 18 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; co12 ; 46 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT1[3] ; 45 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT1[2] ; 198 ; -- ; 19 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT1[1] ; 39 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT1[0] ; 199 ; -- ; 20 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT1[3] ; 190 ; -- ; 15 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT1[2] ; 162 ; -- ; 3 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT1[1] ; 172 ; -- ; 8 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT1[0] ; 127 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q1[3] ; 170 ; -- ; 8 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q1[2] ; 132 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q1[1] ; 94 ; -- ; 7 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q1[0] ; 135 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT2[3] ; 191 ; -- ; 15 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT2[2] ; 163 ; -- ; 4 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT2[1] ; 122 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT2[0] ; 173 ; -- ; 9 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q2[3] ; 89 ; -- ; 9 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q2[2] ; 175 ; -- ; 10 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q2[1] ; 143 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q2[0] ; 147 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT3[3] ; 192 ; -- ; 16 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT3[2] ; 134 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT3[1] ; 93 ; -- ; 7 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT3[0] ; 179 ; -- ; 12 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q3[3] ; 115 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q3[2] ; 41 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q3[1] ; 116 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q3[0] ; 120 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT4[3] ; 44 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT4[2] ; 164 ; -- ; 4 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT4[1] ; 101 ; -- ; 3 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT4[0] ; 95 ; -- ; 6 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q4[3] ; 168 ; -- ; 6 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q4[2] ; 96 ; -- ; 5 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q4[1] ; 111 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q4[0] ; 97 ; -- ; 5 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT2[3] ; 40 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT2[2] ; 119 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT2[1] ; 112 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT2[0] ; 63 ; -- ; 19 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT5[3] ; 187 ; -- ; 13 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT5[2] ; 202 ; -- ; 21 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT5[1] ; 131 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT5[0] ; 88 ; -- ; 10 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q5[3] ; 60 ; -- ; 21 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q5[2] ; 204 ; -- ; 22 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q5[1] ; 57 ; -- ; 22 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q5[0] ; 31 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT6[3] ; 73 ; -- ; 14 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT6[2] ; 55 ; -- ; 23 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT6[1] ; 28 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUT6[0] ; 174 ; -- ; 9 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q6[3] ; 26 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q6[2] ; 133 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q6[1] ; 169 ; -- ; 7 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q6[0] ; 90 ; -- ; 8 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q7[3] ; 29 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q7[2] ; 136 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q7[1] ; 27 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q7[0] ; 167 ; -- ; 6 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q8[3] ; 193 ; -- ; 17 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q8[2] ; 195 ; -- ; 17 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q8[1] ; 65 ; -- ; 18 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q8[0] ; 196 ; -- ; 18 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT3[3] ; 200 ; -- ; 20 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT3[2] ; 62 ; -- ; 19 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT3[1] ; 47 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; BT3[0] ; 61 ; -- ; 20 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q9[3] ; 10 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q9[2] ; 17 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q9[1] ; 148 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; Q9[0] ; 149 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QA[3] ; 19 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QA[2] ; 12 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QA[1] ; 150 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QA[0] ; 70 ; -- ; 15 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QB[3] ; 11 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QB[2] ; 144 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QB[1] ; 56 ; -- ; 22 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QB[0] ; 18 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUTC[3] ; 189 ; -- ; 14 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUTC[2] ; 71 ; -- ; 14 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUTC[1] ; 186 ; -- ; 13 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; OUTC[0] ; 68 ; -- ; 16 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QC[3] ; 38 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QC[2] ; 74 ; -- ; 13 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QC[1] ; 75 ; -- ; 13 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; QC[0] ; 69 ; -- ; 16 ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
- ; DOUT1[6] ; 103 ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT1[2] ; 159 ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT1[4] ; 102 ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT1[3] ; 160 ; -- ; 2 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT1[1] ; 158 ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT1[0] ; 104 ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT1[5] ; 157 ; -- ; 1 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[6] ; 180 ; -- ; 12 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[4] ; 86 ; -- ; 11 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[5] ; 177 ; -- ; 11 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[0] ; 176 ; -- ; 11 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[3] ; 85 ; -- ; 11 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[2] ; 83 ; -- ; 12 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT2[1] ; 128 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[6] ; 208 ; -- ; 24 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[2] ; 53 ; -- ; 24 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[3] ; 54 ; -- ; 24 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[1] ; 207 ; -- ; 24 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[5] ; 206 ; -- ; 23 ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[0] ; 141 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- ; DOUT3[4] ; 16 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; yes ; TTL ;
- +----------+-------+-----+------+--------------+--------------------------+---------------+----------------+---------------+---------------+------------+---------------+--------------+
- +-----------------------------------+
- ; All Package Pins ;
- +-------+------------+--------------+
- ; Pin # ; Usage ; I/O Standard ;
- +-------+------------+--------------+
- ; 1 ; #TCK ; ;
- ; 2 ; ^CONF_DONE ; ;
- ; 3 ; ^nCEO ; ;
- ; 4 ; #TDO ; ;
- ; 5 ; VCC_IO ; ;
- ; 6 ; VCC_INT ; ;
- ; 7 ; NC ; ;
- ; 8 ; NC ; ;
- ; 9 ; NC ; ;
- ; 10 ; Q9[3] ; TTL ;
- ; 11 ; QB[3] ; TTL ;
- ; 12 ; QA[2] ; TTL ;
- ; 13 ; co10 ; TTL ;
- ; 14 ; NC ; ;
- ; 15 ; NC ; ;
- ; 16 ; DOUT3[4] ; TTL ;
- ; 17 ; Q9[2] ; TTL ;
- ; 18 ; QB[0] ; TTL ;
- ; 19 ; QA[3] ; TTL ;
- ; 20 ; GND_IO ; ;
- ; 21 ; GND_INT ; ;
- ; 22 ; VCC_IO ; ;
- ; 23 ; VCC_INT ; ;
- ; 24 ; co5 ; TTL ;
- ; 25 ; co6 ; TTL ;
- ; 26 ; Q6[3] ; TTL ;
- ; 27 ; Q7[1] ; TTL ;
- ; 28 ; OUT6[1] ; TTL ;
- ; 29 ; Q7[3] ; TTL ;
- ; 30 ; co7 ; TTL ;
- ; 31 ; Q5[0] ; TTL ;
- ; 32 ; GND_IO ; ;
- ; 33 ; GND_INT ; ;
- ; 34 ; VCC_IO ; ;
- ; 35 ; VCC_INT ; ;
- ; 36 ; NC ; ;
- ; 37 ; NC ; ;
- ; 38 ; QC[3] ; TTL ;
- ; 39 ; BT1[1] ; TTL ;
- ; 40 ; BT2[3] ; TTL ;
- ; 41 ; Q3[2] ; TTL ;
- ; 42 ; VCC_IO ; ;
- ; 43 ; VCC_INT ; ;
- ; 44 ; OUT4[3] ; TTL ;
- ; 45 ; BT1[3] ; TTL ;
- ; 46 ; co12 ; TTL ;
- ; 47 ; BT3[1] ; TTL ;
- ; 48 ; GND_IO ; ;
- ; 49 ; GND_INT ; ;
- ; 50 ; #TMS ; ;
- ; 51 ; #TRST ; ;
- ; 52 ; ^nSTATUS ; ;
- ; 53 ; DOUT3[2] ; TTL ;
- ; 54 ; DOUT3[3] ; TTL ;
- ; 55 ; OUT6[2] ; TTL ;
- ; 56 ; QB[1] ; TTL ;
- ; 57 ; Q5[1] ; TTL ;
- ; 58 ; GND* ; ;
- ; 59 ; GND_IO ; ;
- ; 60 ; Q5[3] ; TTL ;
- ; 61 ; BT3[0] ; TTL ;
- ; 62 ; BT3[2] ; TTL ;
- ; 63 ; BT2[0] ; TTL ;
- ; 64 ; co11 ; TTL ;
- ; 65 ; Q8[1] ; TTL ;
- ; 66 ; VCC_IO ; ;
- ; 67 ; co8 ; TTL ;
- ; 68 ; OUTC[0] ; TTL ;
- ; 69 ; QC[0] ; TTL ;
- ; 70 ; QA[0] ; TTL ;
- ; 71 ; OUTC[2] ; TTL ;
- ; 72 ; GND_IO ; ;
- ; 73 ; OUT6[3] ; TTL ;
- ; 74 ; QC[2] ; TTL ;
- ; 75 ; QC[1] ; TTL ;
- ; 76 ; VCC_INT ; ;
- ; 77 ; VCC_INT ; ;
- ; 78 ; SIGNAL ; TTL ;
- ; 79 ; CLK ; TTL ;
- ; 80 ; GND+ ; ;
- ; 81 ; GND_INT ; ;
- ; 82 ; GND_INT ; ;
- ; 83 ; DOUT2[2] ; TTL ;
- ; 84 ; VCC_IO ; ;
- ; 85 ; DOUT2[3] ; TTL ;
- ; 86 ; DOUT2[4] ; TTL ;
- ; 87 ; co2 ; TTL ;
- ; 88 ; OUT5[0] ; TTL ;
- ; 89 ; Q2[3] ; TTL ;
- ; 90 ; Q6[0] ; TTL ;
- ; 91 ; GND_IO ; ;
- ; 92 ; co1 ; TTL ;
- ; 93 ; OUT3[1] ; TTL ;
- ; 94 ; Q1[1] ; TTL ;
- ; 95 ; OUT4[0] ; TTL ;
- ; 96 ; Q4[2] ; TTL ;
- ; 97 ; Q4[0] ; TTL ;
- ; 98 ; VCC_IO ; ;
- ; 99 ; GND* ; ;
- ; 100 ; GND* ; ;
- ; 101 ; OUT4[1] ; TTL ;
- ; 102 ; DOUT1[4] ; TTL ;
- ; 103 ; DOUT1[6] ; TTL ;
- ; 104 ; DOUT1[0] ; TTL ;
- ; 105 ; ^nCONFIG ; ;
- ; 106 ; VCC_INT ; ;
- ; 107 ; ^MSEL1 ; ;
- ; 108 ; ^MSEL0 ; ;
- ; 109 ; VCC_INT ; ;
- ; 110 ; VCC_IO ; ;
- ; 111 ; Q4[1] ; TTL ;
- ; 112 ; BT2[1] ; TTL ;
- ; 113 ; NC ; ;
- ; 114 ; NC ; ;
- ; 115 ; Q3[3] ; TTL ;
- ; 116 ; Q3[1] ; TTL ;
- ; 117 ; VCC_INT ; ;
- ; 118 ; VCC_IO ; ;
- ; 119 ; BT2[2] ; TTL ;
- ; 120 ; Q3[0] ; TTL ;
- ; 121 ; co3 ; TTL ;
- ; 122 ; OUT2[1] ; TTL ;
- ; 123 ; GND_INT ; ;
- ; 124 ; GND_IO ; ;
- ; 125 ; NC ; ;
- ; 126 ; NC ; ;
- ; 127 ; OUT1[0] ; TTL ;
- ; 128 ; DOUT2[1] ; TTL ;
- ; 129 ; GND_INT ; ;
- ; 130 ; GND_IO ; ;
- ; 131 ; OUT5[1] ; TTL ;
- ; 132 ; Q1[2] ; TTL ;
- ; 133 ; Q6[2] ; TTL ;
- ; 134 ; OUT3[2] ; TTL ;
- ; 135 ; Q1[0] ; TTL ;
- ; 136 ; Q7[2] ; TTL ;
- ; 137 ; VCC_INT ; ;
- ; 138 ; VCC_IO ; ;
- ; 139 ; NC ; ;
- ; 140 ; NC ; ;
- ; 141 ; DOUT3[0] ; TTL ;
- ; 142 ; co9 ; TTL ;
- ; 143 ; Q2[1] ; TTL ;
- ; 144 ; QB[2] ; TTL ;
- ; 145 ; VCC_INT ; ;
- ; 146 ; VCC_IO ; ;
- ; 147 ; Q2[0] ; TTL ;
- ; 148 ; Q9[1] ; TTL ;
- ; 149 ; Q9[0] ; TTL ;
- ; 150 ; QA[1] ; TTL ;
- ; 151 ; GND_INT ; ;
- ; 152 ; GND_IO ; ;
- ; 153 ; #TDI ; ;
- ; 154 ; ^nCE ; ;
- ; 155 ; ^DCLK ; ;
- ; 156 ; ^DATA0 ; ;
- ; 157 ; DOUT1[5] ; TTL ;
- ; 158 ; DOUT1[1] ; TTL ;
- ; 159 ; DOUT1[2] ; TTL ;
- ; 160 ; DOUT1[3] ; TTL ;
- ; 161 ; GND* ; ;
- ; 162 ; OUT1[2] ; TTL ;
- ; 163 ; OUT2[2] ; TTL ;
- ; 164 ; OUT4[2] ; TTL ;
- ; 165 ; VCC_IO ; ;
- ; 166 ; co4 ; TTL ;
- ; 167 ; Q7[0] ; TTL ;
- ; 168 ; Q4[3] ; TTL ;
- ; 169 ; Q6[1] ; TTL ;
- ; 170 ; Q1[3] ; TTL ;
- ; 171 ; GND_IO ; ;
- ; 172 ; OUT1[1] ; TTL ;
- ; 173 ; OUT2[0] ; TTL ;
- ; 174 ; OUT6[0] ; TTL ;
- ; 175 ; Q2[2] ; TTL ;
- ; 176 ; DOUT2[0] ; TTL ;
- ; 177 ; DOUT2[5] ; TTL ;
- ; 178 ; VCC_IO ; ;
- ; 179 ; OUT3[0] ; TTL ;
- ; 180 ; DOUT2[6] ; TTL ;
- ; 181 ; VCC_INT ; ;
- ; 182 ; GND+ ; ;
- ; 183 ; GND+ ; ;
- ; 184 ; CLR ; TTL ;
- ; 185 ; GND_INT ; ;
- ; 186 ; OUTC[1] ; TTL ;
- ; 187 ; OUT5[3] ; TTL ;
- ; 188 ; GND_IO ; ;
- ; 189 ; OUTC[3] ; TTL ;
- ; 190 ; OUT1[3] ; TTL ;
- ; 191 ; OUT2[3] ; TTL ;
- ; 192 ; OUT3[3] ; TTL ;
- ; 193 ; Q8[3] ; TTL ;
- ; 194 ; VCC_IO ; ;
- ; 195 ; Q8[2] ; TTL ;
- ; 196 ; Q8[0] ; TTL ;
- ; 197 ; GND* ; ;
- ; 198 ; BT1[2] ; TTL ;
- ; 199 ; BT1[0] ; TTL ;
- ; 200 ; BT3[3] ; TTL ;
- ; 201 ; GND_IO ; ;
- ; 202 ; OUT5[2] ; TTL ;
- ; 203 ; GND* ; ;
- ; 204 ; Q5[2] ; TTL ;
- ; 205 ; GND* ; ;
- ; 206 ; DOUT3[5] ; TTL ;
- ; 207 ; DOUT3[1] ; TTL ;
- ; 208 ; DOUT3[6] ; TTL ;
- +-------+------------+--------------+
- +-----------------------------------------------------------------------+
- ; Control Signals ;
- +--------------------+---------+---------+---------------+--------------+
- ; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
- +--------------------+---------+---------+---------------+--------------+
- ; 74160:inst|49~22 ; LC1_B7 ; 5 ; Clock ; Non-global ;
- ; 74160:inst2|49~22 ; LC7_A9 ; 5 ; Clock ; Non-global ;
- ; 74160:inst3|49~22 ; LC2_C11 ; 5 ; Clock ; Non-global ;
- ; 74160:inst6|49~22 ; LC5_C6 ; 5 ; Clock ; Non-global ;
- ; 74160:inst7|49~22 ; LC1_B22 ; 5 ; Clock ; Non-global ;
- ; 74160:inst8|49~22 ; LC2_B12 ; 5 ; Clock ; Non-global ;
- ; 74160:inst9|49~22 ; LC7_B6 ; 5 ; Clock ; Non-global ;
- ; 74160:inst10|49~22 ; LC8_B17 ; 5 ; Clock ; Non-global ;
- ; 74160:inst12|49~22 ; LC7_A20 ; 5 ; Clock ; Non-global ;
- ; 74160:inst13|49~22 ; LC3_A16 ; 5 ; Clock ; Non-global ;
- ; 74160:inst14|49~22 ; LC2_A18 ; 5 ; Clock ; Non-global ;
- ; 74160:inst14|49~23 ; LC7_A22 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst15|28 ; LC3_C13 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst15|49~23 ; LC7_C13 ; 1 ; Clock enable ; Non-global ;
- ; xh:inst16|Mux15~15 ; LC1_B1 ; 7 ; Output enable ; Non-global ;
- ; xh:inst17|Mux15~15 ; LC1_B12 ; 7 ; Output enable ; Non-global ;
- ; xh:inst18|Mux15~15 ; LC1_A17 ; 7 ; Output enable ; Non-global ;
- ; CLK ; 79 ; 52 ; Clock ; Pin ;
- ; 13 ; LC1_C21 ; 48 ; Async. clear ; Internal ;
- ; inst4 ; LC2_B5 ; 4 ; Clock ; Non-global ;
- ; CLR ; 184 ; 49 ; Async. clear ; Pin ;
- ; 74160:inst|49~23 ; LC6_B7 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst|28 ; LC4_B7 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst2|49~23 ; LC8_A9 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst2|28 ; LC1_A9 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst3|49~23 ; LC8_C11 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst3|28 ; LC7_C11 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst6|49~23 ; LC8_C6 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst6|28 ; LC6_C6 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst7|49~23 ; LC6_B22 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst7|28 ; LC4_B22 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst8|49~23 ; LC8_B8 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst8|28 ; LC4_B8 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst9|49~23 ; LC8_B6 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst9|28 ; LC4_B6 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst10|49~23 ; LC7_B17 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst10|28 ; LC5_B17 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst12|49~23 ; LC8_A20 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst12|28 ; LC6_A20 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst13|49~23 ; LC7_A16 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst13|28 ; LC6_A16 ; 1 ; Clock enable ; Non-global ;
- ; 74160:inst14|28 ; LC4_A22 ; 1 ; Clock enable ; Non-global ;
- +--------------------+---------+---------+---------------+--------------+
- +-------------------------------------+
- ; Global & Other Fast Signals ;
- +--------+---------+---------+--------+
- ; Name ; Pin # ; Fan-Out ; Global ;
- +--------+---------+---------+--------+
- ; CLK ; 79 ; 52 ; yes ;
- ; 13 ; LC1_C21 ; 48 ; yes ;
- ; SIGNAL ; 78 ; 2 ; no ;
- ; CLR ; 184 ; 49 ; yes ;
- +--------+---------+---------+--------+
- +---------------------------------+
- ; Non-Global High Fan-Out Signals ;
- +-----------------------+---------+
- ; Name ; Fan-Out ;
- +-----------------------+---------+
- ; xh:inst16|STATE[1]~32 ; 34 ;
- ; xh:inst16|STATE[0]~31 ; 29 ;
- ; xh:inst17|Mux7~9 ; 8 ;
- ; xh:inst18|Mux6~19 ; 8 ;
- ; xh:inst18|Mux7~9 ; 8 ;
- ; xh:inst16|Mux7~9 ; 8 ;
- ; xh:inst16|Mux6~19 ; 8 ;
- ; xh:inst17|Mux6~19 ; 8 ;
- ; xh:inst18|Mux8~12 ; 7 ;
- ; 74160:inst3|6~1 ; 7 ;
- ; 74160:inst9|6~1 ; 7 ;
- ; 74160:inst15|6~1 ; 7 ;
- ; 74160:inst6|6~1 ; 7 ;
- ; 74160:inst14|6~1 ; 7 ;
- ; 74160:inst8|6~1 ; 7 ;
- ; xh:inst17|Mux8~12 ; 7 ;
- ; 74160:inst13|6~1 ; 7 ;
- ; xh:inst16|Mux8~12 ; 7 ;
- ; 74160:inst2|6~1 ; 7 ;
- ; 74160:inst7|6~1 ; 7 ;
- ; 74160:inst10|6~1 ; 7 ;
- ; 74160:inst12|6~1 ; 7 ;
- ; xh:inst18|Mux15~16 ; 7 ;
- ; 74160:inst|6~1 ; 7 ;
- ; xh:inst17|Mux15~16 ; 7 ;
- ; xh:inst16|Mux15~16 ; 7 ;
- ; 74160:inst2|9~0 ; 5 ;
- ; 74160:inst9|49~24 ; 5 ;
- ; 74160:inst6|7~1 ; 5 ;
- ; 74160:inst9|7~1 ; 5 ;
- ; xh:inst18|Mux5~12 ; 5 ;
- ; 74160:inst9|9~0 ; 5 ;
- ; 74160:inst6|9~0 ; 5 ;
- ; 74160:inst15|7~1 ; 5 ;
- ; 74160:inst8|49~24 ; 5 ;
- ; 74160:inst15|9~0 ; 5 ;
- ; 74160:inst8|7~1 ; 5 ;
- ; 74160:inst14|49~24 ; 5 ;
- ; 74160:inst14|9~0 ; 5 ;
- ; 74160:inst2|49~24 ; 5 ;
- ; 74160:inst14|7~1 ; 5 ;
- ; 74160:inst2|7~1 ; 5 ;
- ; 74160:inst8|9~0 ; 5 ;
- ; 74160:inst13|49~24 ; 5 ;
- ; 74160:inst3|49~24 ; 5 ;
- ; 74160:inst13|7~1 ; 5 ;
- ; 74160:inst3|7~1 ; 5 ;
- ; 74160:inst13|9~0 ; 5 ;
- ; xh:inst16|Mux5~12 ; 5 ;
- ; 74160:inst7|49~24 ; 5 ;
- +-----------------------+---------+
- +-------------------------------------------------------------------------------------------------------+
- ; Peripheral Signals ;
- +--------------------+---------+---------------+-----------------+---------------------------+----------+
- ; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
- +--------------------+---------+---------------+-----------------+---------------------------+----------+
- ; xh:inst16|Mux15~15 ; LC1_B1 ; Output enable ; no ; yes ; +ve ;
- ; xh:inst17|Mux15~15 ; LC1_B12 ; Output enable ; no ; yes ; +ve ;
- ; xh:inst18|Mux15~15 ; LC1_A17 ; Output enable ; no ; yes ; +ve ;
- ; 13 ; LC1_C21 ; Async. clear ; no ; yes ; -ve ;
- +--------------------+---------+---------------+-----------------+---------------------------+----------+
- +-------------------------------------------+
- ; LAB ;
- +--------------------------+----------------+
- ; Number of Logic Elements ; Number of LABs ;
- +--------------------------+----------------+
- ; 0 ; 33 ;
- ; 1 ; 9 ;
- ; 2 ; 5 ;
- ; 3 ; 1 ;
- ; 4 ; 1 ;
- ; 5 ; 2 ;
- ; 6 ; 2 ;
- ; 7 ; 4 ;
- ; 8 ; 15 ;
- +--------------------------+----------------+
- +----------------------------------------------+
- ; Local Routing Interconnect ;
- +-----------------------------+----------------+
- ; Local Routing Interconnects ; Number of LABs ;
- +-----------------------------+----------------+
- ; 0 ; 49 ;
- ; 1 ; 3 ;
- ; 2 ; 0 ;
- ; 3 ; 1 ;
- ; 4 ; 2 ;
- ; 5 ; 5 ;
- ; 6 ; 12 ;
- +-----------------------------+----------------+
- +---------------------------------------------+
- ; LAB External Interconnect ;
- +----------------------------+----------------+
- ; LAB External Interconnects ; Number of LABs ;
- +----------------------------+----------------+
- ; 0 ; 33 ;
- ; 1 ; 14 ;
- ; 2 ; 6 ;
- ; 3 ; 5 ;
- ; 4 ; 4 ;
- ; 5 ; 0 ;
- ; 6 ; 6 ;
- ; 7 ; 1 ;
- ; 8 ; 0 ;
- ; 9 ; 0 ;
- ; 10 ; 2 ;
- ; 11 ; 0 ;
- ; 12 ; 0 ;
- ; 13 ; 1 ;
- +----------------------------+----------------+
- +-----------------------------------------------------------------------------------------+
- ; Row Interconnect ;
- +-------+--------------------+-----------------------------+------------------------------+
- ; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
- +-------+--------------------+-----------------------------+------------------------------+
- ; A ; 12 / 96 ( 13 % ) ; 3 / 48 ( 6 % ) ; 21 / 48 ( 44 % ) ;
- ; B ; 28 / 96 ( 29 % ) ; 16 / 48 ( 33 % ) ; 8 / 48 ( 17 % ) ;
- ; C ; 9 / 96 ( 9 % ) ; 7 / 48 ( 15 % ) ; 10 / 48 ( 21 % ) ;
- ; Total ; 49 / 288 ( 17 % ) ; 26 / 144 ( 18 % ) ; 39 / 144 ( 27 % ) ;
- +-------+--------------------+-----------------------------+------------------------------+
- +----------------------------+
- ; LAB Column Interconnect ;
- +-------+--------------------+
- ; Col. ; Interconnect Used ;
- +-------+--------------------+
- ; 1 ; 4 / 24 ( 17 % ) ;
- ; 2 ; 3 / 24 ( 13 % ) ;
- ; 3 ; 2 / 24 ( 8 % ) ;
- ; 4 ; 2 / 24 ( 8 % ) ;
- ; 5 ; 3 / 24 ( 13 % ) ;
- ; 6 ; 3 / 24 ( 13 % ) ;
- ; 7 ; 3 / 24 ( 13 % ) ;
- ; 8 ; 4 / 24 ( 17 % ) ;
- ; 9 ; 3 / 24 ( 13 % ) ;
- ; 10 ; 4 / 24 ( 17 % ) ;
- ; 11 ; 4 / 24 ( 17 % ) ;
- ; 12 ; 3 / 24 ( 13 % ) ;
- ; 13 ; 5 / 24 ( 21 % ) ;
- ; 14 ; 4 / 24 ( 17 % ) ;
- ; 15 ; 3 / 24 ( 13 % ) ;
- ; 16 ; 4 / 24 ( 17 % ) ;
- ; 17 ; 3 / 24 ( 13 % ) ;
- ; 18 ; 3 / 24 ( 13 % ) ;
- ; 19 ; 4 / 24 ( 17 % ) ;
- ; 20 ; 3 / 24 ( 13 % ) ;
- ; 21 ; 2 / 24 ( 8 % ) ;
- ; 22 ; 3 / 24 ( 13 % ) ;
- ; 23 ; 2 / 24 ( 8 % ) ;
- ; 24 ; 4 / 24 ( 17 % ) ;
- ; Total ; 78 / 576 ( 14 % ) ;
- +-------+--------------------+
- +---------------------------+
- ; LAB Column Interconnect ;
- +-------+-------------------+
- ; Col. ; Interconnect Used ;
- +-------+-------------------+
- ; 1 ; 0 / 24 ( 0 % ) ;
- ; Total ; 0 / 24 ( 0 % ) ;
- +-------+-------------------+
- +--------------------------------------------------------+
- ; Fitter Resource Usage Summary ;
- +-----------------------------------+--------------------+
- ; Resource ; Usage ;
- +-----------------------------------+--------------------+
- ; Total logic elements ; 196 / 576 ( 34 % ) ;
- ; Registers ; 98 / 576 ( 17 % ) ;
- ; Logic elements in carry chains ; 0 ;
- ; User inserted logic elements ; 0 ;
- ; I/O pins ; 124 / 134 ( 93 % ) ;
- ; -- Clock pins ; 5 ;
- ; -- Dedicated input pins ; 10 / 4 ( 250 % ) ;
- ; Global signals ; 3 ;
- ; EABs ; 0 / 3 ( 0 % ) ;
- ; Total memory bits ; 0 / 6,144 ( 0 % ) ;
- ; Total RAM block bits ; 0 / 6,144 ( 0 % ) ;
- ; Maximum fan-out node ; CLK ;
- ; Maximum fan-out ; 52 ;
- ; Highest non-global fan-out signal ; xh:inst16|STATE[1] ;
- ; Highest non-global fan-out ; 34 ;
- ; Total fan-out ; 776 ;
- ; Average fan-out ; 2.42 ;
- +-----------------------------------+--------------------+
- +---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
- ; Fitter Resource Utilization by Entity ;
- +----------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+------------+----------------------+--------------+
- ; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ; Library Name ;
- +----------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+------------+----------------------+--------------+
- ; |examp1 ; 196 (2) ; 98 ; 0 ; 124 ; 98 (2) ; 48 (0) ; 50 (0) ; 0 (0) ; 0 (0) ; |examp1 ; work ;
- ; |74160:inst10| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst10 ; work ;
- ; |74160:inst12| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst12 ; work ;
- ; |74160:inst13| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst13 ; work ;
- ; |74160:inst14| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst14 ; work ;
- ; |74160:inst15| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst15 ; work ;
- ; |74160:inst2| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst2 ; work ;
- ; |74160:inst3| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst3 ; work ;
- ; |74160:inst6| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst6 ; work ;
- ; |74160:inst7| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst7 ; work ;
- ; |74160:inst8| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst8 ; work ;
- ; |74160:inst9| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst9 ; work ;
- ; |74160:inst| ; 7 (7) ; 4 ; 0 ; 0 ; 3 (3) ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; |examp1|74160:inst ; work ;
- ; |74273:10| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:10 ; work ;
- ; |74273:11| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:11 ; work ;
- ; |74273:12| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:12 ; work ;
- ; |74273:14| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:14 ; work ;
- ; |74273:15| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:15 ; work ;
- ; |74273:16| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:16 ; work ;
- ; |74273:17| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:17 ; work ;
- ; |74273:18| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:18 ; work ;
- ; |74273:19| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:19 ; work ;
- ; |74273:6| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:6 ; work ;
- ; |74273:7| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:7 ; work ;
- ; |74273:8| ; 4 (4) ; 4 ; 0 ; 0 ; 0 (0) ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|74273:8 ; work ;
- ; |xh:inst16| ; 30 (30) ; 2 ; 0 ; 0 ; 28 (28) ; 0 (0) ; 2 (2) ; 0 (0) ; 0 (0) ; |examp1|xh:inst16 ; work ;
- ; |xh:inst17| ; 16 (16) ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|xh:inst17 ; work ;
- ; |xh:inst18| ; 16 (16) ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |examp1|xh:inst18 ; work ;
- +----------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+------------+----------------------+--------------+
- Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
- +-----------------------------------+
- ; Delay Chain Summary ;
- +----------+----------+-------------+
- ; Name ; Pin Type ; Pad to Core ;
- +----------+----------+-------------+
- ; CLK ; Input ; OFF ;
- ; SIGNAL ; Input ; OFF ;
- ; CLR ; Input ; OFF ;
- ; co1 ; Output ; OFF ;
- ; co2 ; Output ; OFF ;
- ; co3 ; Output ; OFF ;
- ; co4 ; Output ; OFF ;
- ; co5 ; Output ; OFF ;
- ; co6 ; Output ; OFF ;
- ; co7 ; Output ; OFF ;
- ; co8 ; Output ; OFF ;
- ; co9 ; Output ; OFF ;
- ; co10 ; Output ; OFF ;
- ; co11 ; Output ; OFF ;
- ; co12 ; Output ; OFF ;
- ; BT1[3] ; Output ; OFF ;
- ; BT1[2] ; Output ; OFF ;
- ; BT1[1] ; Output ; OFF ;
- ; BT1[0] ; Output ; OFF ;
- ; OUT1[3] ; Output ; OFF ;
- ; OUT1[2] ; Output ; OFF ;
- ; OUT1[1] ; Output ; OFF ;
- ; OUT1[0] ; Output ; OFF ;
- ; Q1[3] ; Output ; OFF ;
- ; Q1[2] ; Output ; OFF ;
- ; Q1[1] ; Output ; OFF ;
- ; Q1[0] ; Output ; OFF ;
- ; OUT2[3] ; Output ; OFF ;
- ; OUT2[2] ; Output ; OFF ;
- ; OUT2[1] ; Output ; OFF ;
- ; OUT2[0] ; Output ; OFF ;
- ; Q2[3] ; Output ; OFF ;
- ; Q2[2] ; Output ; OFF ;
- ; Q2[1] ; Output ; OFF ;
- ; Q2[0] ; Output ; OFF ;
- ; OUT3[3] ; Output ; OFF ;
- ; OUT3[2] ; Output ; OFF ;
- ; OUT3[1] ; Output ; OFF ;
- ; OUT3[0] ; Output ; OFF ;
- ; Q3[3] ; Output ; OFF ;
- ; Q3[2] ; Output ; OFF ;
- ; Q3[1] ; Output ; OFF ;
- ; Q3[0] ; Output ; OFF ;
- ; OUT4[3] ; Output ; OFF ;
- ; OUT4[2] ; Output ; OFF ;
- ; OUT4[1] ; Output ; OFF ;
- ; OUT4[0] ; Output ; OFF ;
- ; Q4[3] ; Output ; OFF ;
- ; Q4[2] ; Output ; OFF ;
- ; Q4[1] ; Output ; OFF ;
- ; Q4[0] ; Output ; OFF ;
- ; BT2[3] ; Output ; OFF ;
- ; BT2[2] ; Output ; OFF ;
- ; BT2[1] ; Output ; OFF ;
- ; BT2[0] ; Output ; OFF ;
- ; OUT5[3] ; Output ; OFF ;
- ; OUT5[2] ; Output ; OFF ;
- ; OUT5[1] ; Output ; OFF ;
- ; OUT5[0] ; Output ; OFF ;
- ; Q5[3] ; Output ; OFF ;
- ; Q5[2] ; Output ; OFF ;
- ; Q5[1] ; Output ; OFF ;
- ; Q5[0] ; Output ; OFF ;
- ; OUT6[3] ; Output ; OFF ;
- ; OUT6[2] ; Output ; OFF ;
- ; OUT6[1] ; Output ; OFF ;
- ; OUT6[0] ; Output ; OFF ;
- ; Q6[3] ; Output ; OFF ;
- ; Q6[2] ; Output ; OFF ;
- ; Q6[1] ; Output ; OFF ;
- ; Q6[0] ; Output ; OFF ;
- ; Q7[3] ; Output ; OFF ;
- ; Q7[2] ; Output ; OFF ;
- ; Q7[1] ; Output ; OFF ;
- ; Q7[0] ; Output ; OFF ;
- ; Q8[3] ; Output ; OFF ;
- ; Q8[2] ; Output ; OFF ;
- ; Q8[1] ; Output ; OFF ;
- ; Q8[0] ; Output ; OFF ;
- ; BT3[3] ; Output ; OFF ;
- ; BT3[2] ; Output ; OFF ;
- ; BT3[1] ; Output ; OFF ;
- ; BT3[0] ; Output ; OFF ;
- ; Q9[3] ; Output ; OFF ;
- ; Q9[2] ; Output ; OFF ;
- ; Q9[1] ; Output ; OFF ;
- ; Q9[0] ; Output ; OFF ;
- ; QA[3] ; Output ; OFF ;
- ; QA[2] ; Output ; OFF ;
- ; QA[1] ; Output ; OFF ;
- ; QA[0] ; Output ; OFF ;
- ; QB[3] ; Output ; OFF ;
- ; QB[2] ; Output ; OFF ;
- ; QB[1] ; Output ; OFF ;
- ; QB[0] ; Output ; OFF ;
- ; OUTC[3] ; Output ; OFF ;
- ; OUTC[2] ; Output ; OFF ;
- ; OUTC[1] ; Output ; OFF ;
- ; OUTC[0] ; Output ; OFF ;
- ; QC[3] ; Output ; OFF ;
- ; QC[2] ; Output ; OFF ;
- ; QC[1] ; Output ; OFF ;
- ; QC[0] ; Output ; OFF ;
- ; DOUT1[6] ; Output ; OFF ;
- ; DOUT1[5] ; Output ; OFF ;
- ; DOUT1[4] ; Output ; OFF ;
- ; DOUT1[3] ; Output ; OFF ;
- ; DOUT1[2] ; Output ; OFF ;
- ; DOUT1[1] ; Output ; OFF ;
- ; DOUT1[0] ; Output ; OFF ;
- ; DOUT2[6] ; Output ; OFF ;
- ; DOUT2[5] ; Output ; OFF ;
- ; DOUT2[4] ; Output ; OFF ;
- ; DOUT2[3] ; Output ; OFF ;
- ; DOUT2[2] ; Output ; OFF ;
- ; DOUT2[1] ; Output ; OFF ;
- ; DOUT2[0] ; Output ; OFF ;
- ; DOUT3[6] ; Output ; OFF ;
- ; DOUT3[5] ; Output ; OFF ;
- ; DOUT3[4] ; Output ; OFF ;
- ; DOUT3[3] ; Output ; OFF ;
- ; DOUT3[2] ; Output ; OFF ;
- ; DOUT3[1] ; Output ; OFF ;
- ; DOUT3[0] ; Output ; OFF ;
- +----------+----------+-------------+
- +--------------+
- ; Pin-Out File ;
- +--------------+
- The pin-out file can be found in F:/gtt2/examp1.pin.
- +-----------------+
- ; Fitter Messages ;
- +-----------------+
- Info: *******************************************************************
- Info: Running Quartus II Fitter
- Info: Version 7.2 Build 151 09/26/2007 SJ Full Version
- Info: Processing started: Fri Jan 22 09:53:20 2010
- Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off examp1 -c examp1
- Info: Selected device EPF10K10QI208-4 for design "examp1"
- Info: Fitter is using the Classic Timing Analyzer
- Info: Timing requirements not specified -- optimizing circuit to achieve the following default global requirements
- Info: Assuming a global fmax requirement of 1000 MHz
- Info: Not setting a global tsu requirement
- Info: Not setting a global tco requirement
- Info: Not setting a global tpd requirement
- Info: Inserted 8 logic cells in first fitting attempt
- Info: Started fitting attempt 1 on Fri Jan 22 2010 at 09:53:20
- Info: Fitter placement preparation operations beginning
- Info: Fitter placement preparation operations ending: elapsed time is 00:00:01
- Info: Fitter placement operations beginning
- Info: Fitter placement operations ending: elapsed time is 00:00:01
- Info: Fitter routing operations beginning
- Info: Fitter routing operations ending: elapsed time is 00:00:00
- Info: Quartus II Fitter was successful. 0 errors, 0 warnings
- Info: Allocated 153 megabytes of memory during processing
- Info: Processing ended: Fri Jan 22 09:53:23 2010
- Info: Elapsed time: 00:00:03
