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s3c2410xSio.h
资源名称：s3c2410x_Bsp.rar　[点击查看]
上传用户：ske666
上传日期：2022-03-30
资源大小：371k
文件大小：4k
源码类别：

VxWorks

开发平台：

Objective-C

s3c2410xSio.h：源码内容
  1. /* s3c2410xSio.h - Samsung s3c2410x UART header file */
  3. /* Copyright 2004 HITSAT, Inc. */
  5. #ifndef __INCs3c2410xSioh 
  6. #define __INCs3c2410xSioh 
  8. #ifdef __cplusplus
  9. extern "C" {
  10. #endif
  12. /* Register description OF Samsung s3c2410x UART */
  14. #ifndef _ASMLANGUAGE
  16. /* Register offsets from base address */
  17. #define OFFSET_ULCON (0x00)
  18. #define OFFSET_UCON (0x04)
  19. #define OFFSET_UFCON (0x08)
  20. #define OFFSET_UMCON (0x0c)
  21. /**/
  22. #define OFFSET_UTRSTAT (0x10)
  23. #define OFFSET_UERSTAT (0x14)
  24. #define OFFSET_UFSTAT (0x18)
  25. #define OFFSET_UMSTAT (0x1c)
  26. /**/
  27. #define OFFSET_UTXH (0x20)
  28. #define OFFSET_URXH (0x24)
  29. #define OFFSET_UDIV (0x28)
  32. /* bit mask definitions within ULCON register */
  33. /* bit6 */
  34. #define InfraRed_OFF (0)
  35. #define InfraRed_ON (0x00000001<<6)
  36. /* bit5..3 */
  37. #define NO_PARITY (0)
  38. #define ODD_PARITY (0x00000004<<3)
  39. #define EVEN_PARITY (0x00000005<<3)
  40. /* bit2 */
  41. #define ONE_STOPBIT (0)
  42. #define TWO_STOPBIT (0x00000001<<2)
  43. /* bit1..0 */
  44. #define DATABIT_5 (0)
  45. #define DATABIT_6 (0x00000001)
  46. #define DATABIT_7 (0x00000002)
  47. #define DATABIT_8 (0x00000003)
  49. /* bit mask definitions within UCON register */
  50. /* bit10 */
  51. #define CLK_PCLK (0)
  52. #define CLK_UCLK (0x00000001<<10)
  53. /* bit9 */
  54. #define TxInt_Pulse (0)
  55. #define TxInt_Level (0x00000001<<9)
  56. /* bit8 */
  57. #define RxInt_Pulse (0)
  58. #define RxInt_Level (0x00000001<<8)
  59. /* bit7 */
  60. #define RxTimeOut_OFF (0)
  61. #define RxTimeOut_ON (0x00000001<<7)
  62. /* bit6 */
  63. #define RxErrInt_OFF (0)
  64. #define RxErrInt_ON (0x00000001<<6)
  65. /* bit5 */
  66. #define LOOPBACK_OFF (0)
  67. #define LOOPBACK_ON (0x00000001<<5)
  68. /* bit4 */
  69. #define TxBreak_OFF (0)
  70. #define TxBreak_ON (0x00000001<<4)
  71. /* bit3..2 */
  72. #define TxMode_OFF (0)
  73. #define TxMode_IntPoll (0x00000001<<2)
  74. #define TxMode_DMA03 (0x00000002<<2)
  75. #define TxMode_DMA1 (0x00000003<<2)
  76. /* bit1..0 */
  77. #define RxMode_OFF (0)
  78. #define RxMode_IntPoll (0x00000001)
  79. #define RxMode_DMA03 (0x00000002)
  80. #define RxMode_DMA1 (0x00000003)
  82. /* bit mask definitions within UFCON register */
  83. /* bit7..6 */
  84. #define TxTrigger_0 (0)
  85. #define TxTrigger_4 (0x00000001<<6)
  86. #define TxTrigger_8 (0x00000002<<6)
  87. #define TxTrigger_12 (0x00000003<<6)
  88. /* bit5..4 */
  89. #define RxTrigger_4 (0)
  90. #define RxTrigger_8 (0x00000001<<4)
  91. #define RxTrigger_12 (0x00000002<<4)
  92. #define RxTrigger_16 (0x00000003<<4)
  93. /* bit2 */
  94. #define TxFifoReset (0x00000001<<2)
  95. /* bit1 */
  96. #define RxFifoReset (0x00000001<<1)
  97. /* bit0 */
  98. #define FIFO_OFF (0)
  99. #define FIFO_ON (0x00000001)
  101. /* bit mask definitions within UMCON register */
  102. /* bit4 */
  103. #define AFC_OFF (0)
  104. #define AFC_ON (0x00000001<<4)
  105. /* bit0 */
  106. #define RTS_HIGH (0)
  107. #define RTS_LOW (0x00000001<<0)
  110. /* bit mask definitions within UTRSTAT register */
  111. #define UTRSTAT_TRNSR_EM (0x00000001<<2)
  112. #define UTRSTAT_TB_EM (0x00000001<<1)
  113. #define UTRSTAT_RB_RDY (0x00000001<<0)
  114. /* bit mask definitions within UERSTAT register */
  115. #define UERSTAT_FRM_ERR (0x00000001<<2)
  116. #define UERSTAT_OVR_ERR (0x00000001<<0)
  117. /* bit mask definitions within UFSTAT register */
  118. #define UFSTAT_TXFULL (0x00000001<<9)
  119. #define UFSTAT_RXFULL (0x00000001<<8)
  120. #define UFSTAT_TFCNT (0x00000015<<4)
  121. #define UFSTAT_RFCNT (0x00000015<<0)
  122. /* bit mask definitions within UMSTAT register */
  123. #define UMSTAT_DELTA_CTS (0x00000001<<2)
  124. #define UMSTAT_CTS_LVL (0x00000001<<0)
  125. /* bit mask definitions within UXXH register */
  126. #define UXXH_BYTE (0x000000ff<<0)
  127. /* bit mask definitions within UDIV register */
  128. #define UDIV_DIV (0x0000ffff<<0)
  131. typedef struct s3c2410x_CHAN
  132. {
  133. /* must be first */
  134. SIO_CHAN sio; /* standard SIO_CHAN element */
  136. /* callbacks */
  137. STATUS (*getTxChar) ();  /* installed Tx callback routine */
  138. STATUS (*putRcvChar) (); /* installed Rx callback routine */
  139. void * getTxArg; /* argument to Tx callback routine */
  140. void * putRcvArg; /* argument to Rx callback routine */
  142. UINT32* regs; /* s3c2410x registers */
  143. UINT8  intLevelRx; /* Rx Interrupt level for this device */
  144. UINT8  intLevelTx; /* Tx Interrupt level for this device */
  146. UINT32 channelMode; /* such as INT, POLL modes */
  147. int baudRate; /* the current baud rate */
  148. UINT32 xtal; /* UART clock frequency */     
  150. int options;
  151. } s3c2410x_CHAN;
  154. /* function declarations */
  156. extern void s3c2410xSioInt (s3c2410x_CHAN *pChan);
  157. extern void s3c2410xSioIntTx (s3c2410x_CHAN *pChan);
  158. extern void s3c2410xSioIntRx (s3c2410x_CHAN *pChan);
  159. extern void s3c2410xSioDevInit (s3c2410x_CHAN *pChan);
  161. #endif /* _ASMLANGUAGE */
  163. #ifdef __cplusplus
  164. }
  165. #endif
  166.  
  167. #endif /* __INCs3c2410xSioh */