DS18B20.tan.summary
上传用户:whms_168
上传日期:2022-08-09
资源大小:592k
文件大小:1k
源码类别:

VHDL/FPGA/Verilog

开发平台:

Others

  1. --------------------------------------------------------------------------------------
  2. Timing Analyzer Summary
  3. --------------------------------------------------------------------------------------
  4. Type           : Worst-case tsu
  5. Slack          : N/A
  6. Required Time  : None
  7. Actual Time    : -5.913 ns
  8. From           : DT
  9. To             : DS18B20VHDL:inst4|DATA[7]
  10. From Clock     : --
  11. To Clock       : GCLKP1
  12. Failed Paths   : 0
  13. Type           : Worst-case tco
  14. Slack          : N/A
  15. Required Time  : None
  16. Actual Time    : 26.302 ns
  17. From           : LED4:inst2|Refresh[1]
  18. To             : LEDOUT[4]
  19. From Clock     : GCLKP1
  20. To Clock       : --
  21. Failed Paths   : 0
  22. Type           : Worst-case th
  23. Slack          : N/A
  24. Required Time  : None
  25. Actual Time    : 9.089 ns
  26. From           : DT
  27. To             : DS18B20VHDL:inst4|DATA[6]
  28. From Clock     : --
  29. To Clock       : GCLKP1
  30. Failed Paths   : 0
  31. Type           : Clock Setup: 'GCLKP1'
  32. Slack          : N/A
  33. Required Time  : None
  34. Actual Time    : 59.87 MHz ( period = 16.704 ns )
  35. From           : DS18B20VHDL:inst4|Count[1]
  36. To             : DS18B20VHDL:inst4|DATA[9]
  37. From Clock     : GCLKP1
  38. To Clock       : GCLKP1
  39. Failed Paths   : 0
  40. Type           : Total number of failed paths
  41. Slack          : 
  42. Required Time  : 
  43. Actual Time    : 
  44. From           : 
  45. To             : 
  46. From Clock     : 
  47. To Clock       : 
  48. Failed Paths   : 0
  49. --------------------------------------------------------------------------------------