DS18B20.map.summary
上传用户:whms_168
上传日期:2022-08-09
资源大小:592k
文件大小:0k
源码类别:

VHDL/FPGA/Verilog

开发平台:

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  1. Analysis & Synthesis Status : Successful - Sat Mar 13 15:06:15 2010
  2. Quartus II Version : 8.0 Build 215 05/29/2008 SJ Full Version
  3. Revision Name : DS18B20
  4. Top-level Entity Name : DS18B20
  5. Family : MAX II
  6. Total logic elements : 295
  7. Total pins : 24
  8. Total virtual pins : 0
  9. Total memory bits : 0
  10. DSP block 9-bit elements : 0
  11. Total PLLs : 0
  12. Total DLLs : 0