VHDL/FPGA/Verilog

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Light.map.summary：源码内容

							Analysis & Synthesis Status : Successful - Thu Jun 11 23:37:29 2009
Quartus II Version : 8.0 Build 215 05/29/2008 SJ Full Version
Revision Name : Light
Top-level Entity Name : Light
Family : MAX II
Total logic elements : 77
Total pins : 10
Total virtual pins : 0
Total memory bits : 0
DSP block 9-bit elements : 0
Total PLLs : 0
Total DLLs : 0

						