VHDL/FPGA/Verilog

开发平台：

VHDL

pipe_id.hif：源码内容

							HIF003
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--
-- Warning: do not edit this file!
--
FILES
{
	pipe_id.gdf
	{
		pipe_id [] []
		{
			0 [] [];
		}
	}
}
TREE
{
	pipe_id::(0,0):(0): pipe_id.gdf;
}

						