VHDL/FPGA/Verilog

开发平台：

VHDL

count23.fit.summary：源码内容

							Fitter Status : Successful - Wed Mar 04 15:53:11 2009
Quartus II Version : 7.2 Build 151 09/26/2007 SJ Full Version
Revision Name : count23
Top-level Entity Name : count23
Family : Stratix II
Device : EP2S15F484C3
Timing Models : Final
Logic utilization : < 1 %
    Combinational ALUTs : 10 / 12,480 ( < 1 % )
    Dedicated logic registers : 8 / 12,480 ( < 1 % )
Total registers : 8
Total pins : 9 / 343 ( 3 % )
Total virtual pins : 0
Total block memory bits : 0 / 419,328 ( 0 % )
DSP block 9-bit elements : 0 / 96 ( 0 % )
Total PLLs : 0 / 6 ( 0 % )
Total DLLs : 0 / 2 ( 0 % )

						