8253down.fit.smsg
上传用户:xuqufe
上传日期:2022-08-10
资源大小:2378k
文件大小:1k
源码类别:

VHDL/FPGA/Verilog

开发平台:

VHDL

  1. Extra Info: Performing register packing on registers with non-logic cell location assignments
  2. Extra Info: Completed register packing on registers with non-logic cell location assignments
  3. Extra Info: Started Fast Input/Output/OE register processing
  4. Extra Info: Finished Fast Input/Output/OE register processing
  5. Extra Info: Moving registers into I/O cells, Multiplier Blocks, and RAM blocks to improve timing and density
  6. Extra Info: Finished moving registers into I/O cells, Multiplier Blocks, and RAM blocks