VHDL/FPGA/Verilog

开发平台：

VHDL

_8259A.fit.rpt：源码内容

Fitter report for _8259A
Sun Apr 25 10:20:30 2010
Quartus II Version 7.2 Build 151 09/26/2007 SJ Full Version
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Pin-Out File
5. Fitter Resource Usage Summary
6. Input Pins
7. Output Pins
8. I/O Bank Usage
9. All Package Pins
10. Output Pin Default Load For Reported TCO
11. Fitter Resource Utilization by Entity
12. Delay Chain Summary
13. Pad To Core Delay Chain Fanout
14. Control Signals
15. Global & Other Fast Signals
16. Non-Global High Fan-Out Signals
17. Interconnect Usage Summary
18. LAB Logic Elements
19. LAB Signals Sourced
20. LAB Signals Sourced Out
21. LAB Distinct Inputs
22. Fitter Device Options
23. Operating Settings and Conditions
24. Fitter Messages
25. Fitter Suppressed Messages
----------------
; Legal Notice ;
----------------
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
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programming logic devices manufactured by Altera and sold by
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applicable agreement for further details.
+-------------------------------------------------------------------------------+
; Fitter Summary ;
+------------------------------------+------------------------------------------+
; Fitter Status ; Successful - Sun Apr 25 10:20:29 2010 ;
; Quartus II Version ; 7.2 Build 151 09/26/2007 SJ Full Version ;
; Revision Name ; _8259A ;
; Top-level Entity Name ; pr ;
; Family ; Cyclone II ;
; Device ; EP2C35F672C6 ;
; Timing Models ; Final ;
; Total logic elements ; 223 / 33,216 ( < 1 % ) ;
; Total combinational functions ; 223 / 33,216 ( < 1 % ) ;
; Dedicated logic registers ; 0 / 33,216 ( 0 % ) ;
; Total registers ; 0 ;
; Total pins ; 56 / 475 ( 12 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 0 / 483,840 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; Total PLLs ; 0 / 4 ( 0 % ) ;
+------------------------------------+------------------------------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+-----------------------------------------------------------------------+--------------------------------+--------------------------------+
; Option ; Setting ; Default Value ;
+-----------------------------------------------------------------------+--------------------------------+--------------------------------+
; Device ; EP2C35F672C6 ; ;
; Fit Attempts to Skip ; 0 ; 0.0 ;
; Use smart compilation ; Off ; Off ;
; Maximum processors allowed for parallel compilation ; 1 ; 1 ;
; Use TimeQuest Timing Analyzer ; Off ; Off ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Always Enable Input Buffers ; Off ; Off ;
; Optimize Hold Timing ; IO Paths and Minimum TPD Paths ; IO Paths and Minimum TPD Paths ;
; Optimize Fast-Corner Timing ; Off ; Off ;
; Equivalent RAM and MLAB Paused Read Capabilities ; Care ; Care ;
; PowerPlay Power Optimization ; Normal compilation ; Normal compilation ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix II/II GX/III Cyclone II/III Arria GX ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Fitting ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Logic to Memory Mapping for Fitting ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Stop After Congestion Map Generation ; Off ; Off ;
; Save Intermediate Fitting Results ; Off ; Off ;
+-----------------------------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in F:/[DOCUMENTS]/InterfaceAndCommunication/_8259A/_8259A.pin.
+----------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+------------------------+
; Resource ; Usage ;
+---------------------------------------------+------------------------+
; Total logic elements ; 223 / 33,216 ( < 1 % ) ;
; -- Combinational with no register ; 223 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 0 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 162 ;
; -- 3 input functions ; 42 ;
; -- <=2 input functions ; 19 ;
; -- Register only ; 0 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 223 ;
; -- arithmetic mode ; 0 ;
; ; ;
; Total registers* ; 0 / 34,593 ( 0 % ) ;
; -- Dedicated logic registers ; 0 / 33,216 ( 0 % ) ;
; -- I/O registers ; 0 / 1,377 ( 0 % ) ;
; ; ;
; Total LABs: partially or completely used ; 17 / 2,076 ( < 1 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 56 / 475 ( 12 % ) ;
; -- Clock pins ; 0 / 8 ( 0 % ) ;
; Global signals ; 2 ;
; M4Ks ; 0 / 105 ( 0 % ) ;
; Total memory bits ; 0 / 483,840 ( 0 % ) ;
; Total RAM block bits ; 0 / 483,840 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 0 / 4 ( 0 % ) ;
; Global clocks ; 2 / 16 ( 13 % ) ;
; Average interconnect usage ; 0% ;
; Peak interconnect usage ; 3% ;
; Maximum fan-out node ; sp[1] ;
; Maximum fan-out ; 53 ;
; Highest non-global fan-out signal ; sp[1] ;
; Highest non-global fan-out ; 53 ;
; Total fan-out ; 834 ;
; Average fan-out ; 2.94 ;
+---------------------------------------------+------------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; eoi[0] ; V9 ; 8 ; 5 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[1] ; V10 ; 8 ; 5 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[2] ; L25 ; 5 ; 65 ; 23 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[3] ; AD21 ; 7 ; 61 ; 0 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[4] ; D7 ; 3 ; 9 ; 36 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[5] ; Y15 ; 7 ; 37 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[6] ; L9 ; 2 ; 0 ; 24 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; eoi[7] ; B4 ; 3 ; 1 ; 36 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[0] ; C11 ; 3 ; 29 ; 36 ; 3 ; 15 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[1] ; J10 ; 3 ; 27 ; 36 ; 1 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[2] ; C12 ; 3 ; 29 ; 36 ; 1 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[3] ; G12 ; 3 ; 27 ; 36 ; 2 ; 15 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[4] ; F12 ; 3 ; 27 ; 36 ; 3 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[5] ; B12 ; 3 ; 29 ; 36 ; 0 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[6] ; J11 ; 3 ; 27 ; 36 ; 0 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; isr[7] ; B11 ; 3 ; 29 ; 36 ; 2 ; 14 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[0] ; R7 ; 1 ; 0 ; 14 ; 1 ; 11 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[1] ; R2 ; 1 ; 0 ; 17 ; 2 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[2] ; R4 ; 1 ; 0 ; 16 ; 0 ; 11 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[3] ; R5 ; 1 ; 0 ; 16 ; 1 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[4] ; T9 ; 1 ; 0 ; 16 ; 3 ; 5 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[5] ; T3 ; 1 ; 0 ; 15 ; 3 ; 7 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[6] ; R6 ; 1 ; 0 ; 14 ; 0 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; mask[7] ; T2 ; 1 ; 0 ; 15 ; 2 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[0] ; U1 ; 1 ; 0 ; 13 ; 1 ; 11 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[1] ; P3 ; 1 ; 0 ; 17 ; 0 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[2] ; R3 ; 1 ; 0 ; 17 ; 3 ; 11 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[3] ; P4 ; 1 ; 0 ; 17 ; 1 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[4] ; T10 ; 1 ; 0 ; 16 ; 2 ; 5 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[5] ; P7 ; 1 ; 0 ; 15 ; 0 ; 7 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[6] ; P6 ; 1 ; 0 ; 15 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; request[7] ; T4 ; 1 ; 0 ; 14 ; 2 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; sm ; K9 ; 3 ; 5 ; 36 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; sp[0] ; F11 ; 3 ; 18 ; 36 ; 1 ; 44 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; sp[1] ; A6 ; 3 ; 3 ; 36 ; 0 ; 53 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; sp[2] ; P9 ; 2 ; 0 ; 25 ; 4 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; code[0] ; E8 ; 3 ; 7 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; code[1] ; L7 ; 2 ; 0 ; 24 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; code[2] ; J9 ; 3 ; 5 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; intr ; L10 ; 2 ; 0 ; 23 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[0] ; AD6 ; 8 ; 5 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[1] ; AD7 ; 8 ; 5 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[2] ; M22 ; 5 ; 65 ; 22 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[3] ; AF22 ; 7 ; 59 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[4] ; F9 ; 3 ; 9 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[5] ; Y14 ; 7 ; 37 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[6] ; L3 ; 2 ; 0 ; 24 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_clr[7] ; C5 ; 3 ; 1 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[0] ; M2 ; 2 ; 0 ; 23 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[1] ; G9 ; 3 ; 7 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[2] ; W10 ; 8 ; 7 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[3] ; Y10 ; 8 ; 7 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[4] ; W8 ; 8 ; 7 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[5] ; H8 ; 3 ; 7 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[6] ; AC7 ; 8 ; 7 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; isr_set[7] ; M4 ; 2 ; 0 ; 23 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
+------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 16 / 64 ( 25 % ) ; 3.3V ; -- ;
; 2 ; 9 / 59 ( 15 % ) ; 3.3V ; -- ;
; 3 ; 19 / 56 ( 34 % ) ; 3.3V ; -- ;
; 4 ; 0 / 58 ( 0 % ) ; 3.3V ; -- ;
; 5 ; 2 / 65 ( 3 % ) ; 3.3V ; -- ;
; 6 ; 1 / 59 ( 2 % ) ; 3.3V ; -- ;
; 7 ; 4 / 58 ( 7 % ) ; 3.3V ; -- ;
; 8 ; 8 / 56 ( 14 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A2 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A3 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A4 ; 484 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A5 ; 482 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A6 ; 479 ; 3 ; sp[1] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; A7 ; 465 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A8 ; 457 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A9 ; 451 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A10 ; 447 ; 3 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A11 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A13 ; 430 ; 4 ; GND+ ; ; ; ; Column I/O ; ; -- ; -- ;
; A14 ; 427 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A15 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A16 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A17 ; 412 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A18 ; 406 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A19 ; 394 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A20 ; 390 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A21 ; 382 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A22 ; 379 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A23 ; 378 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A24 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A25 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; AA1 ; 107 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA2 ; 106 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA3 ; 117 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA4 ; 116 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA5 ; 120 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA6 ; 130 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA7 ; 129 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA8 ; ; ; VCCA_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; AA9 ; 152 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA10 ; 153 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA11 ; 155 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA12 ; 179 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA13 ; 192 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA14 ; 194 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA15 ; 197 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA16 ; 209 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA17 ; 219 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA18 ; 220 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA19 ; ; ; VCCA_PLL4 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; AA20 ; 230 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA21 ; ; ; GND_PLL4 ; gnd ; ; ; -- ; ; -- ; -- ;
; AA22 ; ; 6 ; VCCIO6 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; AA23 ; 256 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA24 ; 255 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA25 ; 266 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AA26 ; 267 ; 6 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AB1 ; 115 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AB2 ; 114 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AB3 ; 126 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AB4 ; 127 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; AB5 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; AB6 ; ; 8 ; VCCIO8 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; AB7 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; AB8 ; 147 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
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