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一个直接数字频率合成的查表程序,VHDL语言,使用7128调试通过
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伪随机序列发生器的vhdl算法
设计一个伪随机序列发生器,采用的生成多项式为1+X^3+X^7。要求具有一个RESET端和两个控制端来调整寄存器初值(程序中设定好四种非零初值可选)。
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_TENNIS 基于FPGA的乒乓球游戏硬件电路的设计与实现,有完整的 代码,并有PDF详细说明如何 VHDL - www_pudn_com.files
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vhdl的一些源代码,包括dds 设计,交通灯设计,信号发生器设计的一些源代码
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