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serial.rar
文件大小： 2k
下载次数：8
源码类别：

VHDL/FPGA/Verilog

开发平台：

VHDL

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资源说明：本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。 程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控制器，10个bit是1位起始位，8个数据位，1个结束位。 串口的波特律由程序中定义的div_par参数决定，更改该参数可以实现相应的波特率。程序当前设定的div_par 的值 是0x104，对应的波特率是9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间划分为8个时隙以使通 信同步. 程序的基本工作过程是，按动一个按键SW0，控制器向PC的串口发送“welcome"， PC机接收后显示验证数据是否正确（串口调试工具设成按ASCII码接受方式）. PC可随时向CPLD发送0-F的十六进制数据，CPLD接受后显示在7段数码管上.
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