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hw1.zip
文件大小： 357k
下载次数：2
源码类别：

VHDL/FPGA/Verilog

开发平台：

VHDL

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资源说明：Using the schematic Design Entry Method, design a logic circuit that has two 2-bit inputs X and Y, a 1-bit input CinOrBin, and a 1-bit control input SubAddn. When the control input SubAddn is ‘0’, the logic circuit behaves as a 2-bit adder ( X + Y + CinOrBin ) with CinOrBin as the carry-in when the control input SubAddn is ‘1’ and the logic circuit behaves as a 2-bit subtracter ( X – Y – CinOrBin ) with CinOrBin as the borrow-in. You must use Half-Adders and Half-Subtracters as building blocks to obtain a structured design.
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