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VERILOG-HDL.rar
本书简要介绍了Verilog硬件描述语言的基础知识,包括语言的基本内容和基本结构 ,以及利用该语言在各种层次上对数字系统的建模方法。书中列举了大量实例,帮助读者掌握语言本身和建模方法,对实际数字系统设计也很有帮助。本书是Verilog HDL的初级读本,适用于作为计算机、电子、电气及自控等专业相关课程的教材,也可供有关的科研人员作为参考书。
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Verilog.rar
在Verilog中有两种类型的赋值语句:连续赋值和过程赋值。赋值表达式由三个部分组成:左值、赋值运算符(=或<=)和右值。右值可以是任何类型的数据,包括net型和register型;但对连续赋值,左值必须是net类型的数据;而过程赋值,左值必须是register类型的数据。下面将作详细描述
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