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verilog.HDL.examples.rar
上传用户：saul_905
上传日期：2013-11-27
文件大小：
184k
下载次数：2821
源码类别：
VHDL/FPGA/Verilog
开发平台：
Visual C++ (VC++)
资源说明：许多非常有用的 Verilog 实例: ADC, FIFO, ADDER, MULTIPLIER 等
- full_adder_2.v
- fifo.v.txt
- encoder8x3.v
- lead_8bits_adder.v
- half_adder_3.v
- nco.v.txt
- mult_piped_8x8.v
- mult_select.v
- COMPARE.V
- string.v.txt
- full_adder_1.v
- half_adder_1.v
- pic.v.txt
- frequency5x2.v
- onehot.v.txt
- FIFO.V
- TEST.V
- MUL16.V
- cla_8bits.v
- mult16.v.txt
- dds.v.txt
- lead_8bits_adder2.v
- div16.v.txt
- gencrc.v.txt
- FIFO_2.V
- framer.v.txt
- binarytogray.v
- encoder8x3_2.v
- myrand.c.txt
- test_cla_8bits.v
- adder_8bit_2.v
- testing.v.txt
- SHIFTER.V
- MUX8X8.V
- sequence_dectect.v
- multi_select_1.v
- DECODER1.V
- ALL.V
- wpulse.v.txt
- decoder3x8.v
- fifo_16x16.v
- ADC_16bit.v
- adder_8bit.v
- half_adder_2.v
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